參數資料
| 型號： | MC9S08GT32CFD |
| 廠商： | Freescale Semiconductor |
| 文件頁數： | 126/290頁 |
| 文件大小： | 0K |
| 描述： | MCU 8BIT 32K FLASH 48-QFN |
| 標準包裝： | 260 |
| 系列： | S08 |
| 核心處理器： | S08 |
| 芯體尺寸： | 8-位 |
| 速度： | 40MHz |
| 連通性： | I²C，SCI，SPI |
| 外圍設備： | LVD，POR，PWM，WDT |
| 輸入/輸出數： | 39 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 數據轉換器： | A/D 8x10b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 48-VFQFN 裸露焊盤 |
| 包裝： | 托盤 |
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Inter-Integrated Circuit (IIC) Module
MC9S08GB/GT Data Sheet, Rev. 2.3
Freescale Semiconductor
211
13.4
Interrupts
The IIC generates a single interrupt.
An interrupt from the IIC is generated when any of the events in Table 13-1 occur provided the IICIE bit
is set. The interrupt is driven by bit IICIF (of the IIC status register) and masked with bit IICIE (of the IIC
control register). The IICIF bit must be cleared by software by writing a one to it in the interrupt routine.
The user can determine the interrupt type by reading the status register.
13.4.1
Byte Transfer Interrupt
The TCF (transfer complete ag) bit is set at the falling edge of the 9th clock to indicate the completion of
byte transfer.
13.4.2
Address Detect Interrupt
When its own specic address (IIC address register) is matched with the calling address, the IAAS bit in
status register is set. The CPU is interrupted provided the IICIE is set. The CPU must check the SRW bit
and set its Tx mode accordingly.
13.4.3
Arbitration Lost Interrupt
The IIC is a true multi-master bus that allows more than one master to be connected on it. If two or more
masters try to control the bus at the same time, the relative priority of the contending masters is determined
by a data arbitration procedure. The IIC module asserts this interrupt when it loses the data arbitration
process and the ARBL bit in the status register is set.
Arbitration is lost in the following circumstances:
SDA sampled as a low when the master drives a high during an address or data transmit cycle.
SDA sampled as a low when the master drives a high during the acknowledge bit of a data receive
cycle.
A START cycle is attempted when the bus is busy.
A repeated START cycle is requested in slave mode.
A STOP condition is detected when the master did not request it.
This bit must be cleared by software by writing a one to it.
Table 13-1. Interrupt Summary
Interrupt Source
Status
Flag
Local Enable
Complete 1-byte transfer
TCF
IICIF
IICIE
Match of received calling
address
IAAS
IICIF
IICIE
Arbitration Lost
ARBL
IICIF
IICIE
相關PDF資料 |
PDF描述 |
|---|---|
| MC9S08DZ60CLCR | MCU 8BIT 60K FLASH 32-LQFP |
| MC9S08DV96MLH | MCU 8BIT 96K FLASH 64-LQFP |
| MC9S08DV96MLF | MCU 8BIT 96K FLASH 48-LQFP |
| MC9S08DV96CLL | MCU 8BIT 96K FLASH 100-LQFP |
| MC9S08DV96CLH | MCU 8BIT 96K FLASH 64-LQFP |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC9S08GT32CFDE | 功能描述:8位微控制器 -MCU 8BIT 32K FLASH 4K RAM RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| MC9S08GT32CFDER | 功能描述:8位微控制器 -MCU 8B 32K FLASH 4K RAM RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| MC9S08GT32CFU | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9S08GT32CMC | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9S08GT60 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Microcontrollers |
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