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參數(shù)資料
| 型號： | MC9S08RE32CFDE |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, QCC48 |
| 封裝： | 7 X 7 MM, 1 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, MO-220VKKD-2, TQFN-48 |
| 文件頁數(shù)： | 193/234頁 |
| 文件大小： | 1758K |
| 代理商： | MC9S08RE32CFDE |
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Resets, Interrupts, and System Conguration
MC9S08RC/RD/RE/RG Data Sheet, Rev. 1.11
Freescale Semiconductor
61
5.5.2.2
Edge and Level Sensitivity
The IRQMOD control bit recongures the detection logic so it detects edge events and pin levels. In this
edge detection mode, the IRQF status ag becomes set when an edge is detected (when the IRQ pin
changes from the deasserted to the asserted level), but the ag is continuously set (and cannot be cleared)
as long as the IRQ pin remains at the asserted level.
5.5.3
Interrupt Vectors, Sources, and Local Masks
Table 5-1 provides a summary of all interrupt sources. Higher-priority sources are located towards the
bottom of the table. The high-order byte of the address for the interrupt service routine is located at the
rst address in the vector address column, and the low-order byte of the address for the interrupt service
routine is located at the next higher address.
When an interrupt condition occurs, an associated ag bit becomes set. If the associated local interrupt
enable is 1, an interrupt request is sent to the CPU. Within the CPU, if the global interrupt mask (I bit in
the CCR) is 0, the CPU will nish the current instruction; stack the PCL, PCH, X, A, and CCR CPU
registers; set the I bit; and then fetch the interrupt vector for the highest priority pending interrupt.
Processing then continues in the interrupt service routine.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MC9S08RD8FJE | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP32 |
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參數(shù)描述 |
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