參數(shù)資料
型號： MCIMX253DVM4
廠商： Freescale Semiconductor
文件頁數(shù)： 19/153頁
文件大?。?/td> 0K
描述： IC MPU I.MX25 COMM 400MAPBGA
標(biāo)準(zhǔn)包裝： 90
系列： i.MX25
核心處理器： ARM9
芯體尺寸： 32-位
速度： 400MHz
連通性： 1 線，EBI/EMI，以太網(wǎng)，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG
外圍設(shè)備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 128
程序存儲器類型： 外部程序存儲器
RAM 容量： 144K x 8
電壓 - 電源 (Vcc/Vdd)： 1.15 V ~ 1.52 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 3x12b
振蕩器型： 外部
工作溫度： -20°C ~ 70°C
封裝/外殼： 400-LFBGA
包裝： 托盤
i.MX25 Applications Processor for Consumer and Industrial Products, Rev. 10
Freescale Semiconductor
115
3.7.19.1
UART RS-232 Serial Mode Timing
3.7.19.1.1
UART Transmit Timing in RS-232 Serial Mode
Figure 85 shows the UART transmit timing in RS-232 serial mode, showing only 8 data bits and 1 stop
bit. Table 86 describes the timing parameter (UA1) shown in the figure.
Figure 85. UART RS-232 Serial Mode Transmit Timing Diagram
3.7.19.1.2
UART Receive Timing in RS-232 Serial Mode
Figure 86 shows the UART receive timing in RS-232 serial mode, showing only 8 data bits and 1 stop bit.
Table 87 describes the timing parameter (UA2) shown in the figure.
–
Figure 86. UART RS-232 Serial Mode Receive Timing Diagram
Table 86. UART RS-232 Serial Mode Transmit Timing Parameters
ID
Parameter
Symbol
Min.
Max.
Units
UA1
Transmit Bit Time
tTbit
1/Fbaud_rate
1 – T
ref_clk
2
1 F
baud_rate: Baud rate frequency. The maximum baud rate the UART can support is (ipg_perclk frequency)/16.
2 T
ref_clk: The period of UART reference clock ref_clk (ipg_perclk after RFDIV divider).
1/Fbaud_rate + Tref_clk
—
Table 87. UART RS-232 Serial Mode Receive Timing Parameters
ID
Parameter
Symbol
Min.
Max.
Units
UA2
Receive bit time1
1 The UART receiver can tolerate 1/(16 × Fbaud_rate) tolerance in each bit. But accumulation tolerance in one frame must not
exceed 3/(16
× Fbaud_rate).
tRbit
1/Fbaud_rate
2 – 1/(16
× Fbaud_rate)
2 F
baud_rate: Baud rate frequency. The maximum baud rate the UART can support is (ipg_perclk frequency)/16.
1/Fbaud_rate + 1/(16
× Fbaud_rate)
—
Bit 1
Bit 2
Bit 0
Bit 4
Bit 5
Bit 6
Bit 7
TXD
(output)
Bit 3
Start
Bit
STOP
BIT
Next
Start
Bit
Possible
Parity
Bit
Par Bit
UA1
Bit 1
Bit 2
Bit 0
Bit 4
Bit 5
Bit 6
Bit 7
RXD
(input)
Bit 3
Start
Bit
STOP
BIT
Next
Start
Bit
Possible
Parity
Bit
Par Bit
UA2
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PDF描述
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參數(shù)描述
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