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    參數(shù)資料
    型號(hào): MCIMX253DVM4
    廠商: Freescale Semiconductor
    文件頁數(shù): 4/153頁
    文件大?。?/td> 0K
    描述: IC MPU I.MX25 COMM 400MAPBGA
    標(biāo)準(zhǔn)包裝: 90
    系列: i.MX25
    核心處理器: ARM9
    芯體尺寸: 32-位
    速度: 400MHz
    連通性: 1 線,EBI/EMI,以太網(wǎng),I²C,MMC,智能卡,SPI,SSI,UART/USART,USB OTG
    外圍設(shè)備: DMA,I²S,LCD,POR,PWM,WDT
    輸入/輸出數(shù): 128
    程序存儲(chǔ)器類型: 外部程序存儲(chǔ)器
    RAM 容量: 144K x 8
    電壓 - 電源 (Vcc/Vdd): 1.15 V ~ 1.52 V
    數(shù)據(jù)轉(zhuǎn)換器: A/D 3x12b
    振蕩器型: 外部
    工作溫度: -20°C ~ 70°C
    封裝/外殼: 400-LFBGA
    包裝: 托盤
    i.MX25 Applications Processor for Consumer and Industrial Products, Rev. 10
    Freescale Semiconductor
    101
    Figure 75. TRST Timing Diagram
    Table 78. SJC Timing Parameters
    ID
    Parameter
    All Frequencies
    Unit
    Min.
    Max.
    SJ1
    TCK cycle time
    1001
    1 In cases where SDMA TAP is put in the chain, the maximum TCK frequency is limited by the maximum ratio of 1:8 of SDMA
    core frequency to TCK. This implies a maximum frequency of 8.25 MHz (or 121.2 ns) for a 66 MHz IPG clock.
    —ns
    SJ2
    TCK clock pulse width measured at VM
    2
    2 V
    M – mid point voltage
    40
    ns
    SJ3
    TCK rise and fall times
    3
    ns
    SJ4
    Boundary scan input data set-up time
    10
    ns
    SJ5
    Boundary scan input data hold time
    50
    ns
    SJ6
    TCK low to output data valid
    50
    ns
    SJ7
    TCK low to output high impedance
    50
    ns
    SJ8
    TMS, TDI data set-up time
    10
    ns
    SJ9
    TMS, TDI data hold time
    50
    ns
    SJ10
    TCK low to TDO data valid
    44
    ns
    SJ11
    TCK low to TDO high impedance
    44
    ns
    SJ12
    TRST assert time
    100
    ns
    SJ13
    TRST set-up time to TCK low
    40
    ns
    TCK
    (Input)
    TRST
    (Input)
    SJ13
    SJ12
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