參數(shù)資料
型號： MCIMX31LCVMN4DR2
廠商： Freescale Semiconductor
文件頁數(shù)： 29/108頁
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描述： IC MPU I.MX31L AUTO 473MAPBGA
標準包裝： 750
系列： i.MX31
核心處理器： ARM11
芯體尺寸： 32-位
速度： 400MHz
連通性： 1 線，ATA，EBI/EMI，F(xiàn)IR，I²C，MMC/SD，PCMCIA，SIM，SPI，SSI，UART/USART，USB，USB OTG
外圍設(shè)備： DMA，LCD，POR，PWM，WDT
程序存儲器類型： ROMless
RAM 容量： 16K x 8
電壓 - 電源 (Vcc/Vdd)： 1.22 V ~ 3.3 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 473-LFBGA
包裝： 帶卷 (TR)
Electrical Characteristics
MCIMX31C/MCIMX31LC Technical Data, Rev. 4.3
Freescale Semiconductor
27
Figure 16. UDMA In Device Terminates Transfer Timing Diagram
Table 25. UDMA In Burst Timing Parameters
ATA
Parameter
from
Description
Controlling Variable
tack
tack (min) = (time_ack * T) – (tskew1 + tskew2)
time_ack
tenv
tenv (min) = (time_env * T) – (tskew1 + tskew2)
tenv (max) = (time_env * T) + (tskew1 + tskew2)
time_env
tds
tds1
tds – (tskew3) – ti_ds > 0
tskew3, ti_ds, ti_dh
should be low enough
tdh
tdh1
tdh – (tskew3) – ti_dh > 0
tcyc
tc1
(tcyc – tskew) > T
T big enough
trp
trp (min) = time_rp * T – (tskew1 + tskew2 + tskew6)
time_rp
—tx11
1 There is a special timing requirement in the ATA host that requires the internal DIOW to go only high 3 clocks after the last
active edge on the DSTROBE signal. The equation given on this line tries to capture this constraint.
2. Make ton and toff big enough to avoid bus contention
(time_rp * T) – (tco + tsu + 3T + 2 *tbuf + 2*tcable2) > trfs (drive)
time_rp
tmli
tmli1
tmli1 (min) = (time_mlix + 0.4) * T
time_mlix
tzah
tzah (min) = (time_zah + 0.4) * T
time_zah
tdzfs
tdzfs = (time_dzfs * T) – (tskew1 + tskew2)
time_dzfs
tcvh
tcvh = (time_cvh *T) – (tskew1 + tskew2)
time_cvh
—ton
toff
ton = time_on * T – tskew1
toff = time_off * T – tskew1
—
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PDF描述
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