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參數(shù)資料
| 型號： | MK1574-01SLF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 8/10頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PLL FRAME RATE COMM 16-SOIC |
| 標準包裝： | 48 |
| 類型： | 時鐘/頻率合成器 |
| PLL： | 是 |
| 輸入： | 時鐘 |
| 輸出： | CMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:3 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 8kHz |
| 除法器/乘法器： | 無/是 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-SOIC（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 16-SOIC |
| 包裝： | 管件 |
MK1574
3.3 VOLT FRAME RATE COMMUNICATIONS PLL
CLOCK SYNTHESIZER
IDT / ICS 3.3 VOLT FRAME RATE COMMUNICATIONS PLL
7
MK1574
REV F 111605
Loop Filter Constants
This table shows the constants K1 and K2 that are used with the equations on page 6 to calculate the external loop filter
components.
Loop Filter Contstants for MK1574-01
PC Board Layout
A proper board layout is critical to the successful use of the MK1574. In particular, the CAP1 and CAP2 pins are
very sensitive to noise and leakage (CAP1 at pin 4 is the most sensitive). Traces must be as short as possible and
the capacitor and resistor must be mounted next to the device as shown to the right. The capacitor connected
between pins 3 and 5 is the power supply decoupling capacitor. The high frequency output clocks on may benefit
from a series 33
resistor connected close to the pin (not shown).
Decode
Address
Loop Filter Constants
FS3:0
(Hex)
K1
K2
0000
0
Reserved
0001
1
Reserved
0010
2
Reserved
0011
3
Reserved
0100
4
0.0430
7.4
0101
5
0.0527
6.0
0110
6
0.0444
7.2
0111
7
0.0454
7.0
1000
8
0.0533
6.0
1001
9
0.0410
7.8
1010
A
0.0508
6.3
1011
B
0.0587
5.4
1100
C
0.0365
8.7
1101
D
0.0420
7.6
1110
E
0.0516
6.2
1111
F
0.0594
5.4
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PDF描述 |
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