參數(shù)資料
型號： MM912H634CM1AE
廠商： Freescale Semiconductor
文件頁數(shù)： 11/349頁
文件大?。?/td> 0K
描述： IC 64KS12 LIN2XLS/HS ISENSE
標(biāo)準(zhǔn)包裝： 250
應(yīng)用： 自動
核心處理器： HCS12
程序存儲器類型： 閃存（64 kB）
控制器系列： HCS12
RAM 容量： 6K x 8
接口： LIN
電源電壓： 5.5 V ~ 27 V
工作溫度： -40°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP 裸露焊盤
包裝： 管件
供應(yīng)商設(shè)備封裝： 48-LQFP 裸露焊盤（7x7）
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Serial Communication Interface (S08SCIV4)
MM912_634 Advance Information, Rev. 10.0
Freescale Semiconductor
108
5.16.2.2
SCI Control Register 1 (SCIC1)
This read/write register is used to control various optional features of the SCI system.
Table 138. SCI Control Register 1 (SCIC1)
Offset(101
0x42
Access: User read/write
7
654
32
10
R
LOOPS
0
RSRC
M
0
ILT
PE
PT
W
Reset
0
000
00
Note:
101. Offset related to 0x0200 for blocking access and 0x300 for non blocking access within the global address space.
Table 139. SCIC1 Field Descriptions
Field
Description
7
LOOPS
Loop Mode Select — Selects between loop back modes and normal 2-pin full-duplex modes. When LOOPS = 1, the transmitter
output is internally connected to the receiver input.
0
Normal operation — RxD and TxD use separate pins.
1
Loop mode or single-wire mode where transmitter outputs are internally connected to receiver input. (See RSRC bit.)
RxD pin is not used by SCI.
5
RSRC
Receiver Source Select — This bit has no meaning or effect unless the LOOPS bit is set to 1. When LOOPS = 1, the receiver
input is internally connected to the TxD pin and RSRC determines whether this connection is also connected to the transmitter
output.
0
Provided LOOPS = 1, RSRC = 0 selects internal loop back mode and the SCI does not use the RxD pins.
1
Single-wire SCI mode where the TxD pin is connected to the transmitter output and receiver input.
4
M
9-Bit or 8-Bit Mode Select
0
Normal — start + 8 data bits (LSB first) + stop.
1
Receiver and transmitter use 9-bit data characters start + 8 data bits (LSB first) + 9th data bit + stop.
2
ILT
Idle Line Type Select — Setting this bit to 1 ensures that the stop bit and logic 1 bits at the end of a character do not count
toward the 10 or 11 bit times of logic high level needed by the idle line detection logic. Refer to Section 5.16.3.3.2.1, “Idle-line
Wake-up" for more information.
0
Idle character bit count starts after start bit.
1
Idle character bit count starts after stop bit.
1
PE
Parity Enable — Enables hardware parity generation and checking. When parity is enabled, the most significant bit (MSB) of
the data character (eighth or ninth data bit) is treated as the parity bit.
0
No hardware parity generation or checking.
1
Parity enabled.
0
PT
Parity Type — Provided parity is enabled (PE = 1), this bit selects even or odd parity. Odd parity means the total number of 1s
in the data character, including the parity bit, is odd. Even parity means the total number of 1s in the data character, including
the parity bit, is even.
0
Even parity.
1
Odd parity.
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PDF描述
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參數(shù)描述
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MM912H634DM1AE 功能描述:16位微控制器 - MCU 64KS12 LIN2XLS/HS ISENSE RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時(shí)鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
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