參數(shù)資料
型號： MPC852TVR50
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： Hardware Specifications
中文描述： 硬件規(guī)格
文件頁數(shù)： 37/80頁
文件大?。?/td> 3080K
代理商： MPC852TVR50
MPC852T Hardware Specifications, Rev. 3.1
Freescale Semiconductor
37
Bus Signal Timing
Table 12
shows the PCMCIA port timing for the MPC852T.
Figure 28
provides the PCMCIA output port timing for the MPC852T.
Figure 28. PCMCIA Output Port Timing
Figure 29
provides the PCMCIA output port timing for the MPC852T.
Figure 29. PCMCIA Input Port Timing
Table 12. PCMCIA Port Timing
Num
Characteristic
33 MHz
40 MHz
50 MHz
66 MHz
Unit
Min
Max
Min
Max
Min
Max
Min
Max
J95
CLKOUT to OPx Valid (MAX = 0.00 x B1 +
19.00)
—
19.00
—
19.00
—
19.00
—
19.00
ns
J96
HRESET negated to OPx drive
1
(MIN = 0.75 x
B1 + 3.00)
1
OP2 and OP3 only.
25.70
—
21.70
—
18.00
—
14.40
—
ns
J97
IP_Xx valid to CLKOUT rising edge (MIN = 0.00
x B1 + 5.00)
5.00
—
5.00
—
5.00
—
5.00
—
ns
J98
CLKOUT rising edge to IP_Xx invalid (MIN =
0.00 x B1 + 1.00)
1.00
—
1.00
—
1.00
—
1.00
—
ns
CLKOUT
HRESET
Output
Signals
OP2, OP3
P57
P58
CLKOUT
Input
Signals
P59
P60
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PDF描述
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參數(shù)描述
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