參數(shù)資料
型號(hào)： MSC8101M1375F
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 數(shù)字信號(hào)處理
英文描述： 64-BIT, 68.75 MHz, OTHER DSP, PBGA332
封裝： 17 X 17 MM, LIDDED FLIP CHIP, LEAD FREE, PLASTIC, BGA-332
文件頁(yè)數(shù)： 48/104頁(yè)
文件大?。?/td> 1811K
代理商： MSC8101M1375F
MSC8101 Technical Data, Rev. 18
2-8
Freescale Semiconductor
Physical and Electrical Specifications
2.6.3
Clocking and Timing Characteristics
Figure 2-5.
Start-Up Sequence with CLKIN Started After VDDH and Before VDD
Figure 2-6.
Start-Up Sequence with VDDH Raised Before VDD with CLKIN Started Before VDD = 0.5 V
Table 2-10.
System Clock Parameters
Characteristic
Minimum
Maximum
Unit
Phase Jitter between BCLK and DLLIN
—
0.5
ns
CLKIN frequency1,2
18
100
MHz
CLKIN slope
—
5
ns
DLLIN slope
—
2
ns
CLKOUT frequency jitter
—
(0.01/CLKOUT) + CLKIN jitter
ns
Delay between CLKOUT and DLLIN
—
5
ns
Notes:
1.
Low CLKIN frequency causes poor PLL performance. Choose a CLKIN frequency high enough to keep the frequency after the
predivider (SPLLMFCLK) higher than 18 MHz.
2.
CLKIN should have a 50%
± 5% duty cycle.
Vo
lt
a
g
e
Time
3.3 V
1.6 V
VDDH Nominal
PORESET/TRST asserted
VDD Nominal
CLKIN starts toggling
VDDH applied
PORESET/TRST Deasserted
1
VDD applied
1.06 V
VDDH = Nominal
VDD = Nominal
Vo
lt
a
g
e
Time
o.5 V
3.3 V
1.6 V
VDDH Nominal
PORESET/TRST asserted
VDD Nominal
CLKIN starts toggling
VDDH applied
PORESET/TRST deasserted
1
VDD applied
1.06 V
VDDH = Nominal
VDD = Nominal
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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MSC8101UG/D 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Network Digital Signal Processor
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MSC8101VT1500F 功能描述:IC DSP 16BIT 250MHZ 332-FCPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數(shù)字式信號(hào)處理器） 系列:StarCore 標(biāo)準(zhǔn)包裝:2 系列:StarCore 類型:SC140 內(nèi)核 接口:DSI，以太網(wǎng)，RS-232 時(shí)鐘速率:400MHz 非易失內(nèi)存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:431-FCPBGA（20x20） 包裝:托盤
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