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    參數(shù)資料
    型號(hào): MT9072AV
    廠商: ZARLINK SEMICONDUCTOR INC
    元件分類(lèi): 數(shù)字傳輸電路
    英文描述: Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
    中文描述: DATACOM, FRAMER, PBGA220
    封裝: 17 X 17 MM, 1.30 MM HEIGHT, MO-192, LBGA-220
    文件頁(yè)數(shù): 41/275頁(yè)
    文件大?。?/td> 3738K
    代理商: MT9072AV
    第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)當(dāng)前第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)第138頁(yè)第139頁(yè)第140頁(yè)第141頁(yè)第142頁(yè)第143頁(yè)第144頁(yè)第145頁(yè)第146頁(yè)第147頁(yè)第148頁(yè)第149頁(yè)第150頁(yè)第151頁(yè)第152頁(yè)第153頁(yè)第154頁(yè)第155頁(yè)第156頁(yè)第157頁(yè)第158頁(yè)第159頁(yè)第160頁(yè)第161頁(yè)第162頁(yè)第163頁(yè)第164頁(yè)第165頁(yè)第166頁(yè)第167頁(yè)第168頁(yè)第169頁(yè)第170頁(yè)第171頁(yè)第172頁(yè)第173頁(yè)第174頁(yè)第175頁(yè)第176頁(yè)第177頁(yè)第178頁(yè)第179頁(yè)第180頁(yè)第181頁(yè)第182頁(yè)第183頁(yè)第184頁(yè)第185頁(yè)第186頁(yè)第187頁(yè)第188頁(yè)第189頁(yè)第190頁(yè)第191頁(yè)第192頁(yè)第193頁(yè)第194頁(yè)第195頁(yè)第196頁(yè)第197頁(yè)第198頁(yè)第199頁(yè)第200頁(yè)第201頁(yè)第202頁(yè)第203頁(yè)第204頁(yè)第205頁(yè)第206頁(yè)第207頁(yè)第208頁(yè)第209頁(yè)第210頁(yè)第211頁(yè)第212頁(yè)第213頁(yè)第214頁(yè)第215頁(yè)第216頁(yè)第217頁(yè)第218頁(yè)第219頁(yè)第220頁(yè)第221頁(yè)第222頁(yè)第223頁(yè)第224頁(yè)第225頁(yè)第226頁(yè)第227頁(yè)第228頁(yè)第229頁(yè)第230頁(yè)第231頁(yè)第232頁(yè)第233頁(yè)第234頁(yè)第235頁(yè)第236頁(yè)第237頁(yè)第238頁(yè)第239頁(yè)第240頁(yè)第241頁(yè)第242頁(yè)第243頁(yè)第244頁(yè)第245頁(yè)第246頁(yè)第247頁(yè)第248頁(yè)第249頁(yè)第250頁(yè)第251頁(yè)第252頁(yè)第253頁(yè)第254頁(yè)第255頁(yè)第256頁(yè)第257頁(yè)第258頁(yè)第259頁(yè)第260頁(yè)第261頁(yè)第262頁(yè)第263頁(yè)第264頁(yè)第265頁(yè)第266頁(yè)第267頁(yè)第268頁(yè)第269頁(yè)第270頁(yè)第271頁(yè)第272頁(yè)第273頁(yè)第274頁(yè)第275頁(yè)
    MT9072
    Data Sheet
    41
    Zarlink Semiconductor Inc.
    The relationship between DSTi/CSTi and the voice channels in 8.192 Mbit/s mode is shown in Table 2 (F01-F7 refer
    to the Framer numbers). There are 2 multiplexed streams (DSTi/o0 and CSTi/o0 are used to multiplexed data for
    Framers 0 to 3 and DSTi/o4 and CSTi/o4 is used for framers 5 to 7).
    When the device is in IMA (Inverse Mux for ATM) mode, the mapping is the S-bit followed by 24 PCM channels.
    This relationship is shown in Table 3. Note that the S-bit location in the Table is indicated by the bit number; which
    starts from bit 0. Hence the strict definition of ST-BUS channels is not adhered to. As in a T1 interface the data on
    the DSTi/o is a bit followed by 24 channels.
    When signaling information is written to the MT9072 using ST-BUS control links (as opposed to direct writes by the
    microport to the on-board signaling registers), the CSTi channels corresponding to the selected DSTi channel
    streams are used to transmit the signaling bits. Since the maximum number of signaling bits associated with any
    channel is 4 (in the case of ABCD), only half a CSTi (bits 3 to 0) channel is required for sourcing the signaling bits.
    Bit A is bit 3 from the CSTi stream, Bit B is 2, Bit C is 1 and Bit D is 0. Unused channels and unused bits are tristate.
    In T1 transparent mode, the DSTi data is transparently sent to the PCM24 channels. In transparent mode the data
    on the DSTi streams will appear unaltered on the PCM24 links and data received on the PCM24 link will pass
    unaltered to the DSTo streams. No signaling insertion or extraction is done in transparent mode. If the TxSYNC
    control bit (address Y00) is 1 then the transmit S-bit is overwritten by channel 31 bit 0 in the 2.048 Mbit/s ST-BUS
    mode. In the 8.192 Mbit/s ST-BUS mode the S-bits from channels 124, 125, 126, 127 respectively are used to
    override the transmit S-bit positions for Framers 0 to 3 or 4 to 7 respectively. If T1 Transparent mode and IMA mode
    are both selected then the S-bit and channel bits are transparently mapped as shown in Table 3.
    PCM24 Channels
    1
    2
    3
    4
    5
    6
    7
    8
    9
    10
    11
    12
    13
    14
    15
    16
    ST-BUS Channels
    (DSTi/o and CSTi/o)
    0
    1
    2
    3
    4
    5
    6
    7
    7
    9
    10
    11
    12
    13
    14
    15
    PCM24 Channels
    17
    18
    19
    20
    21
    22
    23
    24
    -
    -
    -
    -
    -
    -
    -
    S-bit
    ST-BUS Channels
    (DSTi/o and CSTi/o)
    16
    17
    18
    19
    20
    21
    22
    23
    24
    x
    25
    x
    26
    x
    27
    x
    28
    x
    29
    x
    30
    x
    31
    Table 1 - ST-BUS vs. PCM24 Channel Relationship for 2.048 Mbit/s DST/CST Streams (T1)
    PCM24 Channels
    1
    2
    3
    4
    5
    6
    7
    8
    9
    10
    11
    12
    13
    14
    15
    16
    ST-BUS
    Chan(DSTi/o
    and CSTi/o)
    F0/4
    F1/5
    F2/6
    F3/7
    0
    1
    2
    3
    4
    5
    6
    7
    8
    9
    10
    11
    12
    13
    14
    15
    16
    17
    18
    19
    20
    21
    22
    23
    24
    25
    26
    27
    28
    29
    30
    31
    32
    33
    34
    35
    36
    37
    38
    39
    40
    41
    42
    43
    44
    45
    46
    47
    48
    49
    50
    51
    52
    53
    54
    55
    56
    57
    58
    59
    60
    61
    62
    63
    PCM24 Channels
    17
    18
    19
    20
    21
    22
    23
    24
    S-bit
    -
    -
    -
    -
    -
    -
    -
    ST-BUS
    Chan(DSTi/o
    and CSTi/o)
    F0/4
    F1/5
    F2/6
    F3/7
    64
    65
    66
    67
    68
    69
    70
    71
    72
    73
    74
    75
    76
    77
    78
    79
    80
    81
    82
    83
    84
    85
    86
    87
    88
    89
    90
    91
    92
    93
    94
    95
    124
    125
    126
    127
    Table 2 - ST-BUS Channel vs. PCM24 Channel Relationship for 8.192 Mbit/s DST/CST Streams (T1)
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    MT90732 制造商:MITEL 制造商全稱(chēng):Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F)
    MT90732AP 制造商:MITEL 制造商全稱(chēng):Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F)
    MT90733 制造商:MITEL 制造商全稱(chēng):Mitel Networks Corporation 功能描述:CMOS DS3 Framer (DS3F)
    MT90733AP 制造商:MITEL 制造商全稱(chēng):Mitel Networks Corporation 功能描述:CMOS DS3 Framer (DS3F)