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參數(shù)資料
| 型號： | MT9072AV |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA220 |
| 封裝： | 17 X 17 MM, 1.30 MM HEIGHT, MO-192, LBGA-220 |
| 文件頁數(shù)： | 91/275頁 |
| 文件大?。?/td> | 3738K |
| 代理商： | MT9072AV |
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MT9072
Data Sheet
91
Zarlink Semiconductor Inc.
14.1.5 T1 Mu-law Milliwatt
If the control bit ADSEQ is one (register address Y01), the Mu-law digital milliwatt sequence (Table 45) defined by
G.711, is available to be transmit on any combination of selected channels. The channels are selected by setting
the TTSTn control bit (register address Y90-YA7). The same sequence is available to replace received data on any
combination of DSTo channels. This is accomplished by setting the RRSTn control bit (register address Y90-YA7)
for the corresponding channel. Note that Bit 1 is the sign bit and is sent first.
14.1.6 T1 Alarms
The alarms shown in Table 46 are detected by the receiver. The status register bits provide real time status of the
alarm, while the interrupt status registers bits provide latched status indications which are cleared when read. Each
interrupt status register may also generate a maskable interrupt. The possible transmitted alarms are also shown in
the table. See the register bit descriptions for details.
PCM 24 Payload Data
Hex
Bit 1
Bit 2
Bit 3
Bit 4
Bit 5
Bit 6
Bit 7
Bit 8
1E
0
0
0
1
1
1
1
0
0B
0
0
0
0
1
0
1
1
0B
0
0
0
0
1
0
1
1
1E
0
0
0
1
1
1
1
0
1E
1
0
0
1
1
1
1
0
8B
1
0
0
0
1
0
1
1
8B
1
0
0
0
1
0
1
1
9E
1
0
0
1
1
1
1
0
Table 45 - Mu Law Digital Milliwatt Pattern (T1)
Control/Status Register
Interrupt Status
Register
Description
Bit
Address
Bit
Address
D4 Yellow Alarm
. This bit is set if bit position 2 of virtually every
DS0 channel is a zero for a period of 600 milliseconds. The alarm is
tolerant of errors by permitting up to 16 ones in a 48 millisecond
integration period. The alarm clears in 200 milliseconds after being
removed from the line.
D4YALM
Y10
D4YALMI
Y35
D4 Yellow Alarm - 48 millisecond sample
. This bit is set if bit
position 2 of virtually every DS0 channel is a zero for a period of 48
milliseconds. The alarm is tolerant of errors by permitting up to 16
ones in the integration period. This bit is updated every 48
milliseconds.
D4Y48
Y10
D4Y48I
Y35
Table 46 - Alarm Control and Status Bits (T1)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT90820 | Large Digital Switch |
| MT90820AL | Large Digital Switch |
| MT90820AL1 | Large Digital Switch |
| MT90823AL1 | 3V Large Digital Switch |
| MT90823 | 3V Large Digital Switch |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT9072AV2 | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays |
| MT90732 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
| MT90732AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
| MT90733 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS DS3 Framer (DS3F) |
| MT90733AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS DS3 Framer (DS3F) |
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