參數(shù)資料
型號： MT92303
廠商： Mitel Networks Corporation
元件分類： Codec
英文描述： 3.3V Quad Interface, Dual Codec(3.3V 四接口雙編解碼器（提供音頻到PCM的接口）)
中文描述： 3.3四種接口，雙編解碼器（3.3四接口雙編解碼器（提供音頻到的PCM的接口））
文件頁數(shù)： 22/34頁
文件大?。?/td> 166K
代理商： MT92303
MT92303
Preliminary Information
22
Address 15h
Read/Write
General: Mode Control (Register x1)
0
PCM_BUS[0]
Selects PCM Data Interface
00 = ST-Bus, 01 = GCI, 10 = SSI
1
PCM_BUS[1]
2
MUTEMODE3[0]
Audio Interface #3: Mic Mute mode control
(see section ‘Microphone Mute Detect’ and table below)
3
MUTEMODE3[1]
4
MUTEMODE2[0]
Audio Interface #2: Mic Mute mode control
(see section ‘Microphone Mute Detect’ and table below)
5
MUTEMODE2[1]
6
MUTE[0]
Software mute for Audio Interface #0
7
MUTE[1]
Software mute for Audio Interface #1
MUTEMODE[1:0]
Mute Operation (see Figure 9)
00
Microphone path enabled (normal operation). ‘Mic Mute Detect’ signal ignored
01
Microphone path disabled (muted) while ‘Mic Mute Detect’ signal is high, and enabled
while low
10
Microphone path disabled (muted) while ‘Mic Mute Detect’ signal is high,
but must be
re-enabled by the external controller
11
Microphone path disabled (muted). ‘Mic Mute Detect’ signal ignored
Address 16h
Read/Write
General: System Clock Frequency, PLL and Software Reset (Register x1)
0
FREQ[0]
System Clock frequency, ‘SYSCLK’. See table below
Note
: Some frequencies need the internal PLL to be enabled
1
FREQ[1]
2
FREQ[2]
3
EN_PLL
Enable PLL (only required for some SYSCLK frequencies). Allow 1ms to settle
4
SW_RESET
‘Software Reset’ - see explanation in section ‘System Reset Options’
5-7
-
UNUSED (Don’t care)
FREQ [2:0]
System Clock (MHz)
Clocking Method
PLL Multiplier
000
20.48
Direct (PLL output not used)
x10
001
20.0
Direct (PLL output not used)
x5
010
25.0
Direct (PLL output not used)
x2
011
50.0
Direct (PLL output not used)
x2
100
2.048
Internal PLL
x10
101
4.096
Internal PLL
x5
110
10.24
Internal PLL
x2
111
10.24 (spare)
Internal PLL
x2
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