參數(shù)資料
型號： ORT8850
英文描述： Field-Programmable System Chip (FPSC) Eight-Channel x 850 Mbits/s Backplane Transceiver
中文描述： 現(xiàn)場可編程系統(tǒng)芯片（促進文化基金）8通道x 850 Mbits /秒背板收發(fā)器
文件頁數(shù)： 14/112頁
文件大小： 2417K
代理商： ORT8850
14
Agere Systems Inc.
Data Sheet
August 2001
Eight-Channel x 850 Mbits/s Backplane Transceiver
ORCA
ORT8850 FPSC
ORT8850 Overview
(continued)
Figure 2. High-Level Diagram of ORT8850 Transceiver
IO RING
SOFT
TXD_A[7:0]
TXSOC_A
TXCLK_A
RXD_A[7:0]
RXSOC_A
RXCLK_A
TRANSMIT
FIFO
RSTN_RX_A
CSYSENB_A
TXD[31:0]
TXSOC
YTRISTN_A
UTXTRISTN_A
RSTN_UTX_A
UTXD_A[31:0]
UTXSOC_A
WUTXCLK_FPGA
PFCLK
PLL
WCD
FPGA
ZRXD_A[31:0]
ZRXSOC_A
ZRXSOCVIOL_A
ZRXALNVIOL_A
WRXCLK_A_FPGA
ZRXCLK_A
STM MACRO + CDR
(8 CHANNELS)
8
8
TX
RX
8
8
2
1
4
12X8
8
10
9
1
CDR + STM
9X8
8 DATA + PAR
LINE_FP, SYS_FP
SYS_CLK
PROT_SW
8 DATA + SPE + C1J1 + PAR +EN
8 RECOVERED CLKS
8 DATA + TOH_CK_EN + TOH_FP
RapidIO
A
UP INTERFACE
PWRUPRST
FROM FPGA
(GOES TO
ALL BLOCKS)
SYSTEM
BUS
TRANSMIT
MODULE
RECEIVE
MODULE
SOFT
TXD_B[7:0]
TXSOC_B
TXCLK_B
RXD_B[7:0]
RXSOC_B
RXCLK_B
TRANSMIT
FIFO
RSTN_RX_B
CSYSENB_B
TXD[31:0]
TXSOC
YTRISTN_B
UTXTRISTN_B
RSTN_UTX_B
UTXD_B[31:0]
UTXSOC_B
WUTXCLK_FPGA
PFCLK
WCD
ZRXD_B[31:0]
ZRXSOC_B
ZRXSOCVIOL_B
ZRXALNVIOL_B
WRXCLK_B_FPGA
ZRXCLK_B
RapidIO
B
TRANSMIT
MODULE
RECEIVE
MODULE
SOFT
TXD_C[7:0]
TXSOC_C
TXCLK_C
RXD_C[7:0]
RXSOC_C
RXCLK_C
TRANSMIT
FIFO
RSTN_RX_C
CSYSENB_C
TXD[31:0]
TXSOC
YTRISTN_C
UTXTRISTN_C
RSTN_UTX_C
UTXD_C[31:0]
UTXSOC_C
WUTXCLK_FPGA
PFCLK
WCD
ZRXD_C[31:0]
ZRXSOC_C
ZRXSOCVIOL_C
ZRXALNVIOL_C
WRXCLK_C_FPGA
ZRXCLK_C
RapidIO
C
TRANSMIT
MODULE
RECEIVE
MODULE
SOFT
8
SOFT
8
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PDF描述
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ORT8850L Field-Programmable System Chip (FPSC) Eight-Channel x 850 Mbits/s Backplane Transceiver
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