參數(shù)資料
型號(hào): PIC18F45J50-I/ML
廠商: Microchip Technology
文件頁數(shù): 56/164頁
文件大?。?/td> 0K
描述: IC PIC MCU FLASH 32K 2V 44-QFN
產(chǎn)品培訓(xùn)模塊: XLP Deep Sleep Mode
PIC18 J Series MCU Overview
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝: 45
系列: PIC® XLP™ 18F
核心處理器: PIC
芯體尺寸: 8-位
速度: 48MHz
連通性: I²C,SPI,UART/USART,USB
外圍設(shè)備: 欠壓檢測/復(fù)位,DMA,POR,PWM,WDT
輸入/輸出數(shù): 34
程序存儲(chǔ)器容量: 32KB(16K x 16)
程序存儲(chǔ)器類型: 閃存
RAM 容量: 3.8K x 8
電壓 - 電源 (Vcc/Vdd): 2.15 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 13x10b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 44-VQFN 裸露焊盤
包裝: 管件
產(chǎn)品目錄頁面: 657 (CN2011-ZH PDF)
配用: AC164322-ND - MODULE SOCKET MPLAB PM3 28/44QFN
2011 Microchip Technology Inc.
DS39931D-page 149
PIC18F46J50 FAMILY
TABLE 10-11: PORTE I/O SUMMARY
TABLE 10-12: SUMMARY OF REGISTERS ASSOCIATED WITH PORTE
Pin
Function
TRIS
Setting
I/O
Type
Description
RE0/AN5/
PMRD
RE0
1
I
ST
PORTE<0> data input; disabled when analog input is
enabled.
0
O
DIG
LATE<0> data output; not affected by analog input.
AN5
1
I
ANA
A/D Input Channel 5; default input configuration on POR.
PMRD
1
I
ST/TTL Parallel Master Port io_rd_in.
0
O
DIG
Parallel Master Port read strobe.
RE1/AN6/
PMWR
RE1
1
I
ST
PORTE<1> data input; disabled when analog input is
enabled.
0
O
DIG
LATE<1> data output; not affected by analog input.
AN6
1
I
ANA
A/D Input Channel 6; default input configuration on POR.
PMWR
1
I
ST/TTL Parallel Master Port io_wr_in.
0
O
DIG
Parallel Master Port write strobe.
RE2/AN7/
PMCS
RE2
1
I
ST
PORTE<2> data input; disabled when analog input is
enabled.
0
O
DIG
LATE<2> data output; not affected by analog input.
AN7
1
I
ANA
A/D Input Channel 7; default input configuration on POR.
PMCS
0
O
DIG
Parallel Master Port byte enable.
Legend:
DIG = Digital level output; TTL = TTL input buffer; ST = Schmitt Trigger input buffer; ANA = Analog level;
I = Input; O = Output; P = Power
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reset
Values
on Page
PORTE(1)
RDPU
REPU
RE2
RE1
RE0
LATE(1)
LATE2
LATE1
LATE0
TRISE(1)
TRISE2
TRISE1
TRISE0
ANCON0
PCFG7(2) PCFG6(2) PCFG5(2)
PCFG4
PCFG3
PCFG2
PCFG1
PCFG0
Legend:
— = unimplemented, read as ‘0’. Shaded cells are not used by PORTE.
Note 1:
These registers are not available on 28-pin devices.
2:
These bits are only available on 44-pin devices.
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