參數(shù)資料
型號: PIC24F16KL401-I/MQ
廠商: Microchip Technology
文件頁數(shù): 150/260頁
文件大?。?/td> 0K
描述: IC MCU 16BIT 16KB FLASH 20-QFN
產(chǎn)品培訓(xùn)模塊: Low Cost PIC24F KL Family Overview
特色產(chǎn)品: PIC24F "KL" Series MCUs
標(biāo)準(zhǔn)包裝: 73
系列: PIC® XLP™ 24F
核心處理器: PIC
芯體尺寸: 16-位
速度: 32MHz
連通性: I²C,IrDA,LIN,SPI,UART/USART
外圍設(shè)備: 欠壓檢測/復(fù)位,HLVD,POR,PWM,WDT
輸入/輸出數(shù): 18
程序存儲器容量: 16KB(5.5K x 24)
程序存儲器類型: 閃存
EEPROM 大?。?/td> 512 x 8
RAM 容量: 1K x 8
電壓 - 電源 (Vcc/Vdd): 1.8 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 12x10b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 20-VQFN 裸露焊盤
包裝: 管件
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CHAPTER 7 16-BIT TIMER/EVENT COUNTERS 0 AND 1
User’s Manual U15905EJ2V1UD
231
(2) PWM output
By setting the TMCn0 and TMCn1 registers as shown in Figure 7-11, the 16-bit timer/event counter can output
a PWM signal, whose frequency is determined according to the setting of the CSn2 to CSn0 bits of the TMCn0
register, with the values that were preset in the CCn0 and CCn1 registers determining the intervals.
When the counter value of the TMn register matches the setting value of the CCn0 register, the TOn output
becomes active. Then, when the counter value of the TMn register matches the setting value of the CCn1
register, the TOn output becomes inactive. The TMn register continues counting. When it overflows, its count
value is cleared to 0000H, and the register continues counting. In this way, a PWM signal whose frequency is
determined according to the setting of the CSn2 to CSn0 bits of the TMCn0 register can be output. When the
setting value of the CCn0 register and the setting value of the CCn1 register are the same, the TOn output
remains inactive and does not change.
The active level of the TOn output can be set by the ALVn bit of the TMCn1 register.
Remark
n = 0, 1
Figure 7-11. Contents of Register Settings When 16-Bit Timer/Event Counter Is Used for PWM Output
Supply input clocks to internal units
Enable count operation
0
1
0/1
0
0/1
1
OSTn ENTOn ALVn
ETIn CCLRn
CMSn1 CMSn0
0/1
0
1
OVFn
TMCn0
TMCn1
CSn2 CSn1 CSn0
TMCEn TMCAEn
Use CCn0 register as compare register
Use CCn1 register as compare register
Disable clearing of TMn register due to
match with CCn0 register
Enable external pulse output (TOn)
Continue counting after TMn register
overflows
ECLRn
Remarks 1. 0/1: Set to 0 or 1 as necessary
2. n = 0, 1
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PDF描述
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