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參數(shù)資料
| 型號(hào)： | PM7341 |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | S/UNI INVERSE MULTIPLEXING FOR ATM, 84 LINKS |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA416 |
| 封裝： | 27 X 27 MM, 2.28 MM HEIGHT, PLASTIC, BGA-416 |
| 文件頁數(shù)： | 34/413頁 |
| 文件大?。?/td> | 3291K |
| 代理商： | PM7341 |
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PRELIMINARY
INVERSE MULTIPLEXING OVER ATM
PM7341 S/UNI-IMA-84
DATASHEET
PMC-2000223
ISSUE 4
INVERSE MULTIPLEXING OVER ATM
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
36
7
DESCRIPTION
The PM7341 S/UNI-IMA-84 is a monolithic integrated circuit that implements the
Inverse Multiplexing for ATM (IMA 1.1) protocol with backward compatibility to
IMA 1.0 and the Transmission Convergence (TC) layer function. The S/UNI-
IMA-84 has two line side interface modes that determine the total number of links
supported: the Scalable Bandwidth Interconnect (SBI) bus interface mode and
the Clock and Data interface mode. In SBI mode, the S/UNI-IMA-84 supports up
to 84 T1, 63 E1 and 3 DS3 (TC only) links where each link is dynamically
configurable to support either IMA 1.1, backward compatible IMA 1.0, ATM over
T1/E1 and up to three ATM over DS3 streams (using HEC delineation).
In the Clock and Data interface mode, the S/UNI-IMA-84 supports 32
independent T1, E1 or unchannelized links. Each link is dynamically configurable
to support either IMA 1.1, backward compatible IMA 1.0, or ATM HEC cell
delineation. ATM over Fractional T1/E1 is also supported. Unchannelized links
may be used to support applications such as G.SHDSL.
All links within an IMA group must be the same nominal rate, however the link
rates within a group can be different across groups.
The Scaleable Bandwidth Interconnect (SBI) high-density byte serial system
interface provides higher levels of integration and dense interconnect. The SBI
bus interconnects up to 84 T1s or 63 E1s asynchronously. The SBI allows
transmit timing to be mastered by the PHY layer device connected to the SBI bus
with the S/UNI-IMA-84 always behaving as a clock slave. In addition to framed
T1s and E1s, the S/UNI-IMA-84 can transport framed DS3 links over the SBI
bus.
The S/UNI-IMA-84 also supports a clock and data interface mode where 32 2-pin
serial clock and data interfaces are provided. Each clock and data interface can
be configured to support either a T1 link, E1 link, or an unchannelized link. For
IMA, all links within a group must be the same nominal rate, but IMA groups
consisting of either E1 or T1 links may coexist within the S/UNI-IMA-84.
Additionally, for cell delineation only, ATM over fractional T1/E1 is supported by
allowing individual DS0 timeslots to be configured as active or inactive.
IMA is a protocol designed to combine the transport bandwidth of multiple links
into a single logical link. The logical link is called a group. The S/UNI-IMA-84 can
support up to 42 independent groups with each group capable of supporting 1 to
32 links. Any link that is not participating in an IMA group can utilize the cell
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7342 | 32 Link Inverse Multiplexer for ATM (IMA) / UNI PHY |
| PM7344 | SATURN QUAD T1/E1 MULTI-PHY USER NETWORK INTERFACE DEVICE |
| PM7345 | SATURN User Network Interface for PDH Applications |
| PM7346 | SATURN QUAD USER NETWORK INTERFACE FOR J2, E3, T3 |
| PM7347 | SATURN USER NETWORK INTERFACE for J2/E3/T3 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM7342 | 制造商:PMC 制造商全稱:PMC 功能描述:32 Link Inverse Multiplexer for ATM (IMA) / UNI PHY |
| PM7344 | 制造商:PMC 制造商全稱:PMC 功能描述:SATURN QUAD T1/E1 MULTI-PHY USER NETWORK INTERFACE DEVICE |
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