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參數(shù)資料
| 型號(hào)： | QLU2108-PQ208C |
| 英文描述： | Telecommunication IC |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 16/22頁 |
| 文件大?。?/td> | 195K |
| 代理商： | QLU2108-PQ208C |
16
www.quicklogic.com
2001 QuickLogic Corporation
QLUX2108-PQ208C Device Data Sheet
8.0 Core Management and Error Handling
On Egress, the Core is designed to handle and report Utopia errors such as Parity error or
wrong cell length. Errored cells are discarded with an error status indication provided to the
user PHY application.
When an errored cell is received on the Utopia interface, the Core discards the complete
cell and provides a cell discard indication to the User PHY application (Signal
eg_err(n)
asserted)
1
together with a cell discard status (Signal
eg_err_stat(1:0)
)
2
.
NOTE:
eg_err is routed to the corresponding
wtx_err
and
etx_err
respectively
(see Figure 13).
Figure 13: Cell Discard Indication
The signals are sampled on the corresponding clocks from the west interface:
erx_... sampled with wrxclk (west receive clock)
wtx_... sampled with wtxclk (west transmit clock)
Table 9: Error Status Word Bit Coding
Error Status Bit
Name
Description
0
PARITY_ERR
Valid when wtx/etx_err is asserted. If set to one indicates that a
cell is discarded with a parity error decoded by the Core.
1
LENGTH_ERR
Valid when wtx/etx_err is asserted. If set to one indicates that a
cell is discarded with a cell length error detected on the Utopia
interface.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| QLU22108-PT280C | Telecommunication IC |
| QLUM2208-PQ208C | Telecommunication IC |
| QLUM2208-PT280C | Telecommunication IC |
| QLUM2216-PQ208C | Telecommunication IC |
| QLUM2216-PT280C | Telecommunication IC |
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參數(shù)描述 |
|---|---|
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