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參數(shù)資料
| 型號： | S5L9276X01 |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 元件分類： | 通用總線功能 |
| 英文描述： | OPTICAL CD MP3 SYSTEM |
| 中文描述： | 光學(xué)CD MP3播放系統(tǒng) |
| 文件頁數(shù)： | 29/50頁 |
| 文件大?。?/td> | 182K |
| 代理商： | S5L9276X01 |
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OPTICAL CD MP3 SYSTEM
S5L9276 (PRELIMINARY SPEC)
29
MODE 3 - Single PLL Mode ( H_CKG_CMD0[2:1] = 10 or 00 , PLL_BYPASS = LOW)
aclk = 12.3159MHz
clk = 36.9MHz
aclk = 16.9344MHz
clk =38.7MHz
aclk = 18.407MHz
clk = 36.8MHz
H_PLL0_P0
20 (D)
19 (D)
21 (D)
H_PLL0_M0
40 (D)
40 (D)
42 (D)
H_PLL0_S0
0 (D)
0 (D)
0 (D)
Host Control
H_PLL0_P1
xxxx xxxx (B)
xxxx xxxx (B)
xxxx xxxx (B)
H_PLL0_M1
xxxx xxxx (B)
xxxx xxxx (B)
xxxx xxxx (B)
H_PLL0_S1
xxxx xxxx (B)
xxxx xxxx (B)
xxxx xxxx (B)
H_CKG_DIV_XY
xx10 xxxx (B)
xxxx xxxx (B)
xx01 xxxx (B)
H_CKG_CMD0
0000 0100 (B)
0000 0000 (B)
0000 0100 (B)
CLK (I)
CONNECTED TO XOUT
PIN SETTING
ACLK_EXT (I)
TIED TO GND
XI
16.9344MHz X-tal
XO
16.9344MHz X-tal
MODE 4 - PLL BYPASS Mode (PLL_BYPASS = HIGH)
aclk = External Source (ACLK_EXT)
clk = External Source (CLK)
H_PLL0_P0
xxxx xxxx (B)
H_PLL0_M0
xxxx xxxx (B)
Host Control
H_PLL0_S0
xxxx xxxx (B)
H_PLL0_P1
xxxx xxxx (B)
H_PLL0_M1
xxxx xxxx (B)
H_PLL0_S1
xxxx xxxx (B)
H_CKG_DIV_XY
xxxx xxxx (B)
H_CKG_CMD0
xxxx xxxx (B)
CLK (I)
System Clock Frequency
PIN SETTING
ACLK_EXT (I)
Audio Clock Frequency (384Fs)
XI
TIED TO GND
XO
OPEN
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| S5L9284 | DIGITAL SIGNAL PROCESSOR |
| S5L9284D01-Q0R0 | IC, 10/100BASE-TX DUAL-PORT DIGI-PHY TRANSCEIVER, QFP14 |
| S5L9284D | DIGITAL SIGNAL PROCESSOR |
| S5L9286F02 | DIGITAL SIGNAL PROCESSOR |
| S5L9286F02-T0R0 | DIGITAL SIGNAL PROCESSOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| S5L9284 | 制造商:SAMSUNG 制造商全稱:Samsung semiconductor 功能描述:DIGITAL SIGNAL PROCESSOR |
| S5L9284D | 制造商:SAMSUNG 制造商全稱:Samsung semiconductor 功能描述:DIGITAL SIGNAL PROCESSOR |
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| S5L9286F01-Q0R0 | 制造商:SAMSUNG 制造商全稱:Samsung semiconductor 功能描述:DIGITAL SIGNAL PROCESSOR FOR CDP |
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