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參數(shù)資料
| 型號(hào)： | SC2200UCL-266 |
| 廠商： | National Semiconductor Corporation |
| 元件分類： | 微處理器 |
| 英文描述： | Thin Client On a Chip |
| 中文描述： | 瘦客戶機(jī)片上 |
| 文件頁(yè)數(shù)： | 226/433頁(yè) |
| 文件大小： | 3255K |
| 代理商： | SC2200UCL-266 |
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www.national.com
226
Revision 3.0
G
Core Logic Module
(Continued)
Index C4h-C7h
User Defined Device 2 Base Address Register (R/W)
Reset Value: 00000000h
31:0
User Defined Device 2 Base Address.
This 32-bit register supports power management (Trap and Idle timer resources) for
a PCMCIA slot or some other device in the system. The value in this register is used as the address comparator for the
device trap/timer logic. The device can be memory or I/O mapped (configured in F0 Index CDh).
The Core Logic module cannot snoop addresses on the Fast-PCI bus unless it actually claims the cycle. Therefore, Traps
and Idle timers cannot support power management of devices on the Fast-PCI bus.
Index C8h-CBh
User Defined Device 3 Base Address Register (R/W)
Reset Value: 00000000h
31:0
User Defined Device 3 Base Address.
This 32-bit register supports power management (Trap and Idle timer resources) for
a PCMCIA slot or some other device in the system. The value in this register is used as the address comparator for the
device trap/timer logic. The device can be memory or I/O mapped (configured in F0 Index CEh).
The Core Logic module cannot snoop addresses on the Fast-PCI bus unless the it actually claims the cycle. Therefore,
Traps and Idle timers cannot support power management of devices on the Fast-PCI bus.
Index CCh
User Defined Device 1 Control Register (R/W)
Reset Value: 00h
7
Memory or I/O Mapped.
Determines how User Defined Device 1 is mapped.
0: I/O.
1: Memory.
Mask.
If bit 7 = 0 (I/O):
Bit 6
0: Disable write cycle tracking
1: Enable write cycle tracking
Bit 5
0: Disable read cycle tracking
1: Enable read cycle tracking
Bits [4:0] Mask for address bits A[4:0]
If bit 7 = 1 (Memory):
Bits [6:0] Mask for address memory bits A[15:9] (512 bytes min. and 64 KB max.) A[8:0] are ignored.
Note:
A "1" in a mask bit means that the address bit is ignored for comparison.
6:0
Index CDh
User Defined Device 2 Control Register (R/W)
Reset Value: 00h
7
Memory or I/O Mapped.
determines how User Defined Device 2 is mapped.
0: I/O
1: Memory
Mask.
If bit 7 = 0 (I/O):
Bit 6
0: Disable write cycle tracking
1: Enable write cycle tracking
Bit 5
0: Disable read cycle tracking
1: Enable read cycle tracking
Bits [4:0] Mask for address bits A[4:0]
If bit 7 = 1 (Memory):
Bits [6:0] Mask for address memory bits A[15:9] (512 bytes min. and 64 KB max.) A[8:0] are ignored.
Note:
A "1" in a mask bit means that the address bit is ignored for comparison.
6:0
Table 5-29. F0: PCI Header and Bridge Configuration Registers for GPIO and LPC Support (Continued)
Bit
Description
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