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參數(shù)資料
| 型號(hào)： | SI5338A-A-GM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 2/44頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK GEN QUAD 700MHZ 24-QFN |
| 標(biāo)準(zhǔn)包裝： | 490 |
| 系列： | MultiSynth™ |
| 類型： | 時(shí)鐘發(fā)生器 |
| PLL： | 是 |
| 輸入： | CML，HCSL，HSCL，LVDS，LVPECL，晶體 |
| 輸出： | CMOS，HCSL. HSTL. LVDS. LVPECL. SSTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:4 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 700MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 1.71 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 24-QFN（4x4） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 628 (CN2011-ZH PDF) |
| 配用： | 336-1747-ND - KIT PROG FIELD SI5338/4/0 336-1556-ND - BOARD EVALUATION SI5338 |
| 其它名稱： | 336-1553-5 |
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Si5338
10
Rev. 1.3
CMOS Output
Resistance
—50
—
SSTL Output
Resistance
—50
—
HSTL Output
Resistance
—50
—
CMOS Output Volt-
age8
VOH
4 mA load
VDDO – 0.3
—
V
VOL
4 mA load
—
0.3
V
SSTL Output Voltage
VOH
SSTL-3
VDDOx = 2.97 to
3.63 V
0.45xVDDO+0.41
—
V
VOL
—
0.45xVDDO
–0.41
V
VOH
SSTL-2
VDDOx = 2.25 to
2.75 V
0.5xVDDO+0.41
—
V
VOL
—
0.5xVDDO–
0.41
V
VOH
SSTL-18
VDDOx = 1.71 to
1.98 V
0.5xVDDO+0.34
—
V
VOL
—
0.5xVDDO–
0.34
V
HSTL Output Voltage
VOH
VDDO = 1.4 to
1.6 V
0.5xVDDO+0.3
—
V
VOL
—
0.5xVDDO –
0.3
V
Duty Cycle5
DC
45
—
55
%
Table 6. Input and Output Clock Characteristics (Continued)
(VDD = 1.8 V –5% to +10%, 2.5 V ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Units
Notes:
1. Use an external 100
resistor to provide load termination for a differential clock. See Figure 3.
2. For best jitter performance, keep the midpoint differential input slew rate on pins 1,2,5,6 faster than 0.3 V/ns.
3. Minimum input frequency in clock buffer mode (PLL bypass) is 5 MHz. Operation to 1 MHz is also supported in buffer
mode, but loss-of-signal (LOS) status is not functional.
4. For best jitter performance, keep the mid point input single ended slew rate on pins 3 or 4 faster than 1 V/ns.
5. Not in PLL bypass mode.
6. Only two unique frequencies above 350 MHz can be simultaneously output, Fvco/4 and Fvco/6. See "3.3. Synthesis
Stages" on page 18.
7. CML output format requires ac-coupling of the differential outputs to a differential 100
load at the receiver.
8. Includes effect of internal series 22
resistor.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICS87608AYILF | IC CLK GEN ZD PCI/PCI-X 32-LQFP |
| VI-2VP-MX-B1 | CONVERTER MOD DC/DC 13.8V 75W |
| ICS87002AG-02LF | IC CLK GENERATOR ZD 1:2 20-TSSOP |
| VI-B43-MW-B1 | CONVERTER MOD DC/DC 24V 100W |
| VI-B1Z-MV-B1 | CONVERTER MOD DC/DC 2V 60W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SI5338A-A-GMR | 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 I2C-program Clk gen 0.16 - 710 MHz RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| SI5338A-B00302-GM | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Bulk |
| SI5338A-B00302-GMR | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Tape and Reel |
| SI5338A-B00419-GM | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Bulk |
| SI5338A-B01206-GM | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Bulk |
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