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參數(shù)資料
| 型號(hào)： | SI5368A-C-GQ |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 18/92頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK MULTIPLIER ATTEN 100TQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | DSPLL® |
| 類型： | 時(shí)鐘放大器，振動(dòng)衰減器 |
| PLL： | 是 |
| 輸入： | 時(shí)鐘 |
| 輸出： | CML，CMOS，LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 4:5 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 1.42GHz |
| 除法器/乘法器： | 無/是 |
| 電源電壓： | 1.71 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-TQFP |
| 供應(yīng)商設(shè)備封裝： | 100-TQFP（14x14） |
| 包裝： | 托盤 |
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Si5368
Rev. 1.0
25
6. Register Descriptions
Reset value = 0001 0100
Register 0.
Bit
D7
D6
D5
D4
D3
D2D1D0
Name
FREE_
RUN
CKOUT_
ALWAYS_ON
CK_CONFIG_
REG
BYPASS_
REG
Type
R
R/W
R
R/W
R
R/W
R
Bit
Name
Function
7
Reserved
6FREE_RUN
Free Run.
Internal to the device, route XA/XB to CKIN2. This allows the device to lock to its external
reference.
0: Disable Free Run
1: Enable
5CKOUT_
ALWAYS_ON
CKOUT Always On.
This will bypass the SQ_ICAL function. Output will be available even if SQ_ICAL is on
and ICAL is not complete or successful. See Table 9.
0: Squelch output until part is calibrated (ICAL).
1: Provide an output. Note: The frequency may be significantly off until the part is
calibrated.
4
Reserved
3
CK_CONFIG_
REG
CK_CONFIG_REG.
This bit controls the input clock configuration for either normal CLKIN function or FSYNC
operation. Whenever CK_CONFIG_REG = 1, FSYNC_ALIGN_MODE must not be set to
1.
0: CKIN_1, 2, 3, 4 inputs do not have a synchronized relationship. CLKOUT5 is an inde-
pendent output. There is no FSYNCOUT.
1: CKIN_1, 3 and CKIN_2, 4 Clock/FSYNC pairs. CKOUT5 is configured as the FSYNC
output.
2
Reserved
1
BYPASS_
REG
Bypass Register.
This bit enables or disables the PLL bypass mode. Use is only valid when the part is in
digital hold or before the first ICAL.
0: Normal operation
1: Bypass mode. Selected input clock is connected to CKOUT buffers, bypassing PLL.
Bypass mode does not support CMOS clock outputs.
0
Reserved
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PDF描述 |
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參數(shù)描述 |
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| Si5368B-B-GQ | 功能描述:鎖相環(huán) - PLL ANY-RATE CLK MULT JITTER ATTEN 5 OUTS RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray |
| SI5368B-B-GQR | 制造商:Silicon Laboratories Inc 功能描述: |
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