參數(shù)資料
型號(hào)： SI5368A-C-GQ
廠商： Silicon Laboratories Inc
文件頁(yè)數(shù)： 30/92頁(yè)
文件大?。?/td> 0K
描述： IC CLK MULTIPLIER ATTEN 100TQFP
標(biāo)準(zhǔn)包裝： 90
系列： DSPLL®
類型： 時(shí)鐘放大器，振動(dòng)衰減器
PLL： 是
輸入： 時(shí)鐘
輸出： CML，CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 4:5
差分 - 輸入:輸出： 是/是
頻率 - 最大： 1.42GHz
除法器/乘法器： 無/是
電源電壓： 1.71 V ~ 3.63 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-TQFP
供應(yīng)商設(shè)備封裝： 100-TQFP（14x14）
包裝： 托盤
Si5368
36
Rev. 1.0
Reset value = 0100 0000
Register 11.
Bit
D7D6D5D4D3D2D1
D0
Name
ALIGN_THR [2:0]
PD_CK4
PD_CK3
PD_CK2
PD_CK1
Type
R/W
R
R/W
Bit
Name
Function
7:5
ALIGN_THR [2:0]
ALIGN_THR [2:0].
These bits control the threshold for the alignment error alarm. Input to output sync
phase skews that deviate more than the alignment threshold from the ideal value
(set by FSYNC_SKEW[16:0]) in either the leading or lagging direction trigger the
alignmentalarm. Value is in units of Tclkout2.
000: 4
001: 8
010: 16
011: 32
100: 48
101: 64
110: 96
111: 128
4
Reserved
3PD_CK4
PD_CK4.
This bit controls the powerdown of the CKIN4 input buffer.
0: CKIN4 enabled
1: CKIN4 disabled
2PD_CK3
PD_CK3.
This bit controls the powerdown of the CKIN3 input buffer.
0: CKIN3 enabled
1: CKIN3 disabled
1PD_CK2
PD_CK2.
This bit controls the powerdown of the CKIN2 input buffer.
0: CKIN2 enabled
1: CKIN2 disabled
0PD_CK1
PD_CK1.
This bit controls the powerdown of the CKIN1 input buffer.
0: CKIN1 enabled
1: CKIN1 disabled
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PDF描述
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參數(shù)描述
SI5368A-C-GQR 功能描述:時(shí)鐘合成器/抖動(dòng)清除器 Precision Clk Xplier Jitter Attn 4In/5Out RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
Si5368B-B-GQ 功能描述:鎖相環(huán) - PLL ANY-RATE CLK MULT JITTER ATTEN 5 OUTS RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray
SI5368B-B-GQR 制造商:Silicon Laboratories Inc 功能描述:
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