參數(shù)資料
型號(hào)： SPAK56854FG120
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 數(shù)字信號(hào)處理
英文描述： 16-BIT, 4 MHz, OTHER DSP, PQFP128
封裝： LQFP-128
文件頁(yè)數(shù)： 210/649頁(yè)
文件大小： 7965K
代理商： SPAK56854FG120
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12-18
DSP56853/854/855/857/858 User’s Manual
MOTOROLA
Preliminary
Functional Description
12
An interrupt can occur after the reception of each data word or the programmer can poll
the RDR flag. The ESSI program response can be one of the following:
Read SRX and use the data
Read SRX and ignore the data
Do nothing—the receiver overrun exception occurs at the end of the current time
slot
12.5.3 Synchronous/Asynchronous Operating Modes
The transmit and receive sections of the ESSI may be synchronous or asynchronous.
During asynchronous operation the transmitter and receiver have their own separate clock
and sync signals. When operating in the Synchronous mode the transmitter and receiver
use common clock and synchronization signals, specified by the transmitter configuration.
The SYN bit in SCR2 selects synchronous or asynchronous operation.
Since the ESSI is designed to operate either synchronously or asynchronously, separate
receive and transmit interrupts are provided. During the synchronous operation, the
receiver and transmitter operate in lock step with each other. Overhead may be reduced by
Table 12-9.
Notes for Receive Timing in Figure 12-6
Note
Source Signal
Destination
Signal
Description
6
——
Example of a five time slot frame, receiving data from time slots 0 and 2.
The receive hardware will obtain data on the SRD pin every bit time.
The software must determine which data belongs to each time slot and
discard the unwanted time slot data.
7SC0
—
Receive clock timing from which it is derived.
8SC1
—
Example with bit length frame sync and standard timing (RFSI=0,
RFSL=1, and REFS=0). Frame timing begins with the rising edge of
SC1.
9SRD
RXSR
Register
Data on the SRD pin is sampled on the falling edge of SC0 and shifted
into the RXSR register.
10
RXSR
Register
SRX
Register
At the word clock, the data in the RXSR register is transferred to the
SRX register.
11
RDR Status Flag
and Receive
Interrupt
—
This flag is set for each word clock (time slot) indicating data is available
to be processed. The software must keep track of the time slots as they
occur so it knows which data to keep.
If the receive interrupts are enabled (RIE=1) an interrupt will be
generated when this status flag is set. The software reads the SRX
register to clear the interrupt.1
1.
Section 12.12 provides a complete description of the interrupt process.
相關(guān)PDF資料
PDF描述
SPAK56F802TA60 0-BIT, 60 MHz, OTHER DSP, PQFP32
SPAK56F805FV80 16-BIT, 8 MHz, OTHER DSP, PQFP144
SPAK56F807VF80 16-BIT, 80 MHz, OTHER DSP, PBGA160
SPAK56F807VF80 16-BIT, 80 MHz, OTHER DSP, PBGA160
SPAK56F826BU80 16-BIT, 80 MHz, OTHER DSP, PQFP100
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
SPAK56857BU120 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor
SPAK56F803BU80 制造商:Freescale Semiconductor 功能描述:
SPAK56F805FV80 制造商:Freescale Semiconductor 功能描述:
SPAKDSP303AG100 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
SPAKDSP303GC100 制造商:Motorola Inc 功能描述:
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