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參數(shù)資料
| 型號： | SPAK56855BU120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP100 |
| 封裝： | LQFP-100 |
| 文件頁數(shù)： | 260/649頁 |
| 文件大?。?/td> | 7965K |
| 代理商： | SPAK56855BU120 |
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12-62
DSP56853/854/855/857/858 User’s Manual
MOTOROLA
Preliminary
Interrupt Operation Description
12
12.11 Interrupts
The ESSI can generate up to six interrupt vectors, listed in Table 12-26.
12.12 Interrupt Operation Description
12.12.1 Receive Data With Exception
This interrupt can occur when receive interrupts are enabled via the RIE bit of the SCR2
register. When a data word is ready to transfer from the RXSR register to the SRX register
and the previous SRX register data has not yet been read, the ROE bit is set and the
exception interrupt will occur instead of the normal receive data interrupt. When the
receive FIFO is enabled this interrupt will not occur until the RFF bit has been set,
indicating the FIFO is full. The ROE bit is cleared when the SSR is read verifying the
ROE bit is set before reading the SRX register data.
12.12.2 Receive Data (RX)
This interrupt can occur when receive interrupts are enabled via the RIE bit of the SCR2
register. When a data word is ready to transfer from the RXSR register to the SRX
register, and the ROE bit is not set, an interrupt will occur indicating received data is
available for processing. When the Receive FIFO is enabled, this interrupt will not occur
until the Receive Watermark level of the FIFO is reached. If the FIFO is not enabled, an
interrupt will occur for each data word received. This interrupt is cleared by reading the
SSR, verifying the RDR bit is set before reading the SRX register data.
12.12.3 Receive Last Slot (RLS)
This interrupt occurs when the ESSI:
Is in the Network mode
Has been enabled via the RLIE bit of the SCR3 register
Table 12-26.
Interrupt Summary
Interrupt
Source
Description
INTR + $0
Receiver
Receive data with exception
INTR + $2
Receiver
Receive data
INTR + $4
Receiver
Receive last slot interrupt. This interrupt may not be present in all
implementations of the ESSI.
INTR + $6
Transmitter
Transmit data with exception
INTR + $8
Transmitter
Transmit data
INTR + $10
Transmitter
Transmit last slot interrupt. This interrupt may not be present in all
implementations of the ESSI.
相關PDF資料 |
PDF描述 |
|---|---|
| SPAK56854FG120 | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| SPAK56F802TA60 | 0-BIT, 60 MHz, OTHER DSP, PQFP32 |
| SPAK56F805FV80 | 16-BIT, 8 MHz, OTHER DSP, PQFP144 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| SPAK56F803BU80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT |
| SPAKDSP303GC100 | 制造商:Motorola Inc 功能描述: |
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