參數(shù)資料
型號(hào)： ST72F60K2DIE6
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, MROM, 8 MHz, MICROCONTROLLER, UUC
文件頁(yè)數(shù)： 85/121頁(yè)
文件大?。?/td> 2515K
代理商： ST72F60K2DIE6
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ST7260
66/117
SERIAL COMMUNICATIONS INTERFACE (Cont’d)
11.3.5 Low Power Modes
11.3.6 Interrupts
The SCI interrupt events are connected to the
same interrupt vector.
These events generate an interrupt if the corre-
sponding Enable Control Bit is set and the inter-
rupt mask in the CC register is reset (RIM instruc-
tion).
Mode
Description
WAIT
No effect on SCI.
SCI interrupts cause the device to exit
from Wait mode.
HALT
SCI registers are frozen.
In Halt mode, the SCI stops transmit-
ting/receiving until Halt mode is exit-
ed.
Interrupt Event
Event
Flag
Enable
Control
Bit
Exit
from
Wait
Exit
from
Halt
Transmit Data Register
Empty
TDRE
TIE
Yes
No
Transmission Com-
plete
TC
TCIE
Yes
No
Received Data Ready
to be Read
RDRF
RIE
Yes
No
Overrun Error Detected
OR
Yes
No
Idle Line Detected
IDLE
ILIE
Yes
No
Parity Error
PE
PIE
Yes
No
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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