參數(shù)資料
型號： ST72F60K2DIE6
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, MROM, 8 MHz, MICROCONTROLLER, UUC
文件頁數(shù)： 93/121頁
文件大?。?/td> 2515K
代理商： ST72F60K2DIE6
ST7260
73/117
USB INTERFACE (Cont’d)
11.4.4 Register Description
DMA ADDRESS REGISTER (DMAR)
Read / Write
Reset Value: Undefined
Bits 7:0=DA[15:8] DMA address bits 15-8.
Software must write the start address of the DMA
memory area whose most significant bits are given
by DA15-DA6. The remaining 6 address bits are
set by hardware. See the description of the IDR
register and Figure 39.
INTERRUPT/DMA REGISTER (IDR)
Read / Write
Reset Value: xxxx 0000 (x0h)
Bits 7:6 = DA[7:6] DMA address bits 7-6.
Software must reset these bits. See the descrip-
tion of the DMAR register and Figure 39.
Bits 5:4 = EP[1:0] Endpoint number (read-only).
These bits identify the endpoint which required at-
tention.
00: Endpoint 0
01: Endpoint 1
10: Endpoint 2
When a CTR interrupt occurs (see register ISTR)
the software should read the EP bits to identify the
endpoint which has sent or received a packet.
Bits 3:0 = CNT[3:0] Byte count (read only).
This field shows how many data bytes have been
received during the last data reception.
Note: Not valid for data transmission.
Figure 39. DMA Buffers
70
DA15
DA14
DA13
DA12
DA11
DA10
DA9
DA8
70
DA7
DA6
EP1
EP0
CNT3
CNT2
CNT1
CNT0
Endpoint 0 RX
Endpoint 0 TX
Endpoint 2 RX
Endpoint 1 TX
000000
000111
001000
001111
010000
010111
011000
011111
DA15-6,000000
Endpoint 1 RX
Endpoint 2 TX
100000
100111
101000
101111
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PDF描述
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