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參數(shù)資料
| 型號： | TMP90CM36 |
| 廠商： | Toshiba Corporation |
| 元件分類： | 通用總線功能 |
| 英文描述： | High Speed Advanced CMOS 8-bit Microcontroller,Integrating RAM，ROM，General Serial Interface,Multifuction Timer/Event Counter，Signal Selector Circuit,PWM Output(高速、先進(jìn)的 CMOS 8位微控制器（芯片集成了ROM，RAM，通用串行接口，多功能定時器/事件計數(shù)器,信號選擇電路，PWM輸出）) |
| 中文描述： | 采用先進(jìn)的CMOS高速8位微控制器，集成內(nèi)存，光盤，通用串行接口，Multifuction定時器/事件計數(shù)器，信號選擇器電路，PWM輸出（高速，先進(jìn)的的CMOS 8位微控制器（芯片集成了ROM和RAM內(nèi)存，通用串行接口，多功能定時器/事件計數(shù)器，信號選擇電路，脈寬調(diào)制輸出）） |
| 文件頁數(shù)： | 128/194頁 |
| 文件大小： | 7013K |
| 代理商： | TMP90CM36 |
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128
TOSHIBA CORPORATION
TMP90CM36
Protocol
Select the 9-bit UART mode for the master and
slave controllers.
Set the SCMOD1 <WU1> bit of each slave control-
ler to “1” to enable data receiving.
The master controller transmits one-frame, includ-
ing the 8-bit select code of the slave controllers.
The MSB (bit 8) SCMOD1 <TB81> is set to “1”.
Each slave controller receives the above frame, and
clears WU bit to “0” if the above select code
matches its own select code.
The master controller transmits data to the specified
slave controller whose SCMOD1 <WU1> bit is
cleared to “0”. The MSB (bit 8) SCMOD1 <TB81> is
set to “0”.
The other slave controllers (with SCMOD1 <WU1>
bit remaining at “1”) ignore the receiving data
because their MSBs (bit 8 or SCCR1 <RB81>) are
set to “0” to disable the interrupt INTRX1.
When the WU1 bit is cleared to “0”, the interrupt
INTRX1 occurs, so that the slave controller can read
the receiving data.
The slave controllers (WU1 = 0) transmit data to the
master controller, and it is possible to indicate the
end of data receiving to the master controller by this
transmission.
Setting example:
To link two slave controllers seri-
ally with the master controller,
and use the internal clock /1
(fc/2) as the transfer clock .
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PDF描述 |
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參數(shù)描述 |
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| TMP90CM38F | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
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