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參數(shù)資料
| 型號： | TMP96C031 |
| 廠商： | Toshiba Corporation |
| 英文描述： | High Speed Advanced CMOS 16-bit Microcontroller For Controlling Medium to Large-Scale Equipment(用于中等到大型設(shè)備控制，高速、先進的 CMOS 16位微控制器) |
| 中文描述： | 采用先進的CMOS高速16位微控制器控制中的大型設(shè)備（用于中等到大型設(shè)備控制，高速，先進的的CMOS 16位微控制器） |
| 文件頁數(shù)： | 145/186頁 |
| 文件大?。?/td> | 5299K |
| 代理商： | TMP96C031 |
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TOSHIBA CORPORATION
145
TMP96C031N/F
3.12.3 Operation
The watchdog timer generates interrupt INTWD after the
detecting time set in the WDMOD <WDTP1, 0> register and
outputs a low level signal. The watchdog timer must be zero-
cleared by software before an INTWD interrupt is generated. If
the CPU malfunctions (runaway) due to causes such as noise,
but does not execute the instruction used to clear the binary
counter, the binary counter overflows and an INTWD interrupt
is generated. The CPU detects malfunction (runaway) due to
the INTWD Interrupt and it is possible to return to normal oper-
ation by an anti-malfunction program. By connecting the
watchdog timer out pin to peripheral devices’ resets, a CPU
malfunction can also be acknowledged to other devices.
The watchdog timer restarts operation immediately after
resetting is released.
The watchdog timer stops its operation in the IDLE and
STOP modes. In the RUN mode, the watchdog timer is
enabled.
However, the function can be disabled when entering the
RUN mode.
Example:
Clear the binary counter
Set the watchdog timer detecting time to 2
18
/fc
Disable the watchdog timer
Set IDLE mode
Set the STOP mode (warming up time: 2
16
/fc)
WDCR
←
0
1
0
0
1
1
1
0
Write clear code (4EH).
WDMOD
←
1
0
1
–
–
–
x
x
WDMOD
WDCR
←
←
0
1
–
0
–
1
–
1
–
0
–
0
x
0
x
1
Clear WDTE to “0".
Write disable code (B1H).
WDMOD
WDCR
Executes HALT command
←
←
0
1
–
0
–
1
–
1
1
0
0
0
x
0
x
1
Disables WDT and sets IDLE mode.
Set the standby mode
WDMOD
Executes HALT command
←
–
–
–
1
0
1
x
x
Set the STOP mode.
Execute HALT instruction. Set the standby mode.
2)
Writing 1 to the P4FC <BUSWDT> register halts count by
the WDT binary counter at bus release due to the bus
request signal, BUSRQ.
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PDF描述 |
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