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參數(shù)資料
| 型號(hào)： | TMP96C031 |
| 廠商： | Toshiba Corporation |
| 英文描述： | High Speed Advanced CMOS 16-bit Microcontroller For Controlling Medium to Large-Scale Equipment(用于中等到大型設(shè)備控制，高速、先進(jìn)的 CMOS 16位微控制器) |
| 中文描述： | 采用先進(jìn)的CMOS高速16位微控制器控制中的大型設(shè)備（用于中等到大型設(shè)備控制，高速，先進(jìn)的的CMOS 16位微控制器） |
| 文件頁數(shù)： | 55/186頁 |
| 文件大?。?/td> | 5299K |
| 代理商： | TMP96C031 |
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TOSHIBA CORPORATION
55
TMP96C031N/F
3.6.3 Default Address Space Specification (B0CS to
B2CS < B0ARE to B2ARE> = “0”)
The following figures show the actual chip select image. CS0
can specify 7F00H to 7FFFH, CS1 can specify 80H to 7FFFH,
and CS2 can specify 8000H to 3FFFFFH. This is because
external connection of devices (such as RAM or I/O) other than
ROM is considered.
The area 7F00 to 7FFFH (256-byte space) for CS0 is
mapped in this space mainly due to external I/O expansion
consideration.
The area 80H to 7FFFH (approximately 32K-byte space)
for CS1 is mapped in this space mainly due to external RAM
expansion consideration.
The area 8000H to 3FFFFFH (approximately 4M-byte
space) for CS2 is mapped in this space mainly due to external
ROM expansion consideration.
Supplement 1: The access priority is in the order of built-in I/O and chip select/wait controller.
Supplement 2: Wait for spaces other than CS0 to CS3 is set with B0CS register <BEXW1,0> and the data bus width is fixed to 16-bit if the AM8/16 pin is “0”
and to 8 bits if it is “1”.
Note:
When using the chip select/wait controller, do not assign multiple definitions to the same address area. (However, if CS0 is set to 7F000H to
7FFFH and CS1 is set to 80H to 7FFFH, only the CS0 setting/pin is active in the overlapped address space 7F00H to 7FFFH.)
When the bus is opened (BUSAK = “0”), CS0 to CS3 pins are also opened (output buffer OFF). Refer to the note on bus open in section “3.5
Port Functions” for the pin status at this point.
CS0
CS1
CS2
7F00H
8000H
80H
8000H
8000H
3FFFFFH
FFFFFFH
FFFFFFH
FFFFFFH
(Mainly for I/O)
(Mainly for RAM)
(Mainly for ROM)
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PDF描述 |
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