- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄385939 > TMPR3904AF (Toshiba Corporation) 32 Bit TX39 Family System RISC Microprocessor(32位TX39系列簡(jiǎn)化指令系統(tǒng)計(jì)算機(jī)微處理器) PDF資料下載
參數(shù)資料
| 型號(hào)： | TMPR3904AF |
| 廠商： | Toshiba Corporation |
| 英文描述： | 32 Bit TX39 Family System RISC Microprocessor(32位TX39系列簡(jiǎn)化指令系統(tǒng)計(jì)算機(jī)微處理器) |
| 中文描述： | 32位TX39家庭系統(tǒng)RISC微處理器（32位TX39系列簡(jiǎn)化指令系統(tǒng)計(jì)算機(jī)微處理器） |
| 文件頁(yè)數(shù)： | 8/28頁(yè) |
| 文件大小： | 209K |
| 代理商： | TMPR3904AF |
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INTEGRATED CIRCUIT
TECHNICAL DATA
TOSIBA RISC PROCESSOR
TMPR3904AF
EJC-TMPR3904AF-8
14-Dec-1998
TOSHIBA CORPORATION
Name
I/O
5V
tolerant
input
A
Function
INT[7:0]
I
Interrupt Request
External interrupt request signals. An active level and level
sensed/edge
triggered
are
configuration register.
designated
by
the
chip
Memory Interface
RAS0[3:0]*
RAS1[3:0]*
CAS[3:0]*
O
-
Row Address Strobe
RAS signals for a DRAM.
Column Address Strobe
CAS signals for a DRAM.
Write Enable
Write enable signal for a DRAM.
Output Enable
Output enable signals of a ROM.
Chip Enable
Chip select signals of a ROM.
SRAM Write Enable
Write enable signals of an SRAM and Flash ROM.
O
-
WE*
O
-
OE0*
OE1*
CE0[1:0]*
CE1[1:0]*
SWE0*
SWE1*
DMA Interface
DREQ[3:0] I
O
-
O
-
O
-
A
(PIO1[7:6]) I/O A
DMA Request
The external I/O device requests a DMA transfer.
DREQ[3:2] are shared with the PIO1.
DMA Acknowledge
Acknowledge signals to DMA transfer request through the
DREQ.
DACK[3:2] are shared with the PIO1.
Done
Input: LOW is input to terminate data transfer.
Output: Notification that transfer ended. This signal is
asserted during one SYSCLK period when DMA transfer ends.
DACK[3:0] O
-
(PIO1[5:4]) I/O A
DONE*
I
A
5V tolerant input : A = Available, N.A = Not Available
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PDF描述 |
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