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參數(shù)資料
| 型號(hào)： | TMS320VC203 |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | Digital Signal Processors(50ns指令周期， 空閑狀態(tài)CPU全關(guān)斷，先進(jìn)的外圍，多種PLL可選) |
| 中文描述： | 數(shù)字信號(hào)處理器（50ns的指令周期，空閑狀態(tài)CPU的全關(guān)斷，先進(jìn)的外圍，多種鎖相環(huán)可選） |
| 文件頁(yè)數(shù)： | 58/67頁(yè) |
| 文件大?。?/td> | 1452K |
| 代理商： | TMS320VC203 |
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TMS320C203, TMS320C209, TMS320VC203
DIGITAL SIGNAL PROCESSOR
SPRS025 – JUNE 1995
58
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
RS, INT1–INT3, NMI, BIO, TOUT, and XF timing
INTN refers to BIO, INT1–INT3, and NMI.
switching characteristics over recommended operating conditions [H = 0.5t
c(CO)
]
’320C2XX-40,
’320C2XX57,
3/5 V
’320C2XX-80
5 V
UNIT
PARAMETER
MIN
0
0
MAX
MIN
0
0
MAX
UNIT
td(XF)
td(TOUT)
tw(TOUT)
3-V operatIon, ’C203 only
Values derived from characterization data and not tested.
Delay time, XF valid after CLKOUT1
13
10
ns
Delay time, TOUT high/low after CLKOUT1
11
11
ns
Pulse duration, TOUT high
2H – 12
2H – 9
ns
timing requirements over recommended operating conditions [H = 0.5t
c(CO)
]
’320C2XX-40,
’320C2XX57,
3/5 V
’320C2XX-80
5 V
UNIT
MIN
MAX
MIN
MAX
UNIT
tsu(RS)CI
tsu(RS)CO
tw(RSL)
td(EX)
tsu(IN)CO
th(IN)CO
tw(IN)
td(IN)
3-V operatIon, ’C203 only
Setup time, RS no longer high before CLKIN low
11
9
ns
Setup time, RS no longer low before CLKOUT1 low
14
10
ns
Pulse duration, RS low
12H
12H
ns
Delay time, RS high to reset-vector fetch
34H
34H
ns
Setup time, INTx before CLKOUT1 low (synchronous)
10
10
ns
Hold time, INTx after CLKOUT1 low (synchronous)
0
0
ns
Pulse duration, INTx low/high
2H + 18
2H + 16
ns
Delay time, INTx low to interrupt-vector fetch
12H
12H
ns
tsu(RS)CI
tsu(RS)CO
RS
CLKOUT1
CLKIN
tw(RSL)
Figure 17. Reset Timing
A
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