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參數(shù)資料
| 型號(hào)： | TS68302 |
| 廠商： | Atmel Corp. |
| 英文描述： | Integrated Multiprotocol Processor IMP |
| 中文描述： | 集成多協(xié)議處理器進(jìn)出口 |
| 文件頁(yè)數(shù)： | 24/47頁(yè) |
| 文件大小： | 1149K |
| 代理商： | TS68302 |
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24
TS68302
2117A–HIREL–11/02
Figure 16.
Internal Master Internal Read Cycle Timing Diagram
AS
(OUTPUT)
(OUTPUT)
IAC
(OUTPUT)
140
141
R/W
(OUTPUT)
D15-D0
(OUTPUT)
145
144
DTACK
(OUTPUT)
143
142
LDS
UDS
(OUTPUT)
A23-A1
(OUTPUT)
CLKO
S0
S1
S2
S3
S4
S5
S6
S7
S0
Table 13.
AC Electrical Specifications - Chip-select Timing Internal Master
(3)
f = 16.67 MHz
Num.
Symbol
Parameter
Min
Max
Unit
150
t
CHCSIAKL
Clock high to CS, IACK low
(1)
40
ns
151
t
CLCSIAKH
Clock low to CS, IACK high
(1)
40
ns
152
t
CSH
CS width negated
60
ns
153
t
CHDTKL
Clock high to DTACK low (0 wait state)
45
ns
154
t
CLDTKL
Clock low to DTACK low (1 - 6 wait states)
30
ns
155
t
CLDTKH
Clock low to DTACK high
40
ns
156
t
CHBERL
Clock high to BERR low
(2)
40
ns
157
t
CLBERH
Clock low to BERR high impedance
(2)
40
ns
158
t
DTKHDTKZ
DTACK high to DTACK high impedance
15
ns
171
t
IDHCL
Input data hold time from S6 low
5
ns
172
t
CSNDOI
CS negated to data out invalid (write)
(4)
10
ns
173
t
AFVCSA
Address, FC valid to CS asserted
(4)
15
ns
174
t
CSNAFI
CS negated to address, FC invalid
(4)
15
ns
175
t
CSLT
CS low time (0 wait states)
(4)
120
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| TS68302VR16 | Integrated Multiprotocol Processor IMP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TS68302CA1B/C16 | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Integrated Multiprotocol Processor IMP |
| TS68302CA1B/T16 | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Integrated Multiprotocol Processor IMP |
| TS68302CR1B/C16 | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Integrated Multiprotocol Processor IMP |
| TS68302CR1B/T16 | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Integrated Multiprotocol Processor IMP |
| TS68302DESC01QXC | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Integrated Multiprotocol Processor IMP |
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