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參數(shù)資料
| 型號： | TSC21020F-20MC-E |
| 英文描述： | FPGA, CYCLONE III, 25K LE, 256UBGA Programmable Logic Type:FPGA; Logic IC function:FPGA; Logic IC family:Cyclone III; Logic IC Base Number:3; I/O lines, No. of:156; |
| 中文描述： | 控制器雜項-數(shù)據(jù)表參考 |
| 文件頁數(shù)： | 34/51頁 |
| 文件大小： | 763K |
| 代理商： | TSC21020F-20MC-E |
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34
TSC21020F
4153F
–
AERO
–
06/03
Bus Request/Bus Grant
Figure 8.
Bus Request/Bus Grant
Parameter
20 MHz
Frequency
Dependency
(1)
Unit
Min
Max
Min
Max
t
HBR
BR Hold after CLKIN High
0
ns
t
SBR
BR Setup before CLKIN High
18
18+5DT/16
ns
t
DMDBGL
Memory Interface Disable
to BG Low
(2)
-2
ns
t
DME
CLKIN High to Memory
Interface Enable
25
25 + DT/2
ns
t
DBGL
CLKIN High to BG Low
22
ns
t
DBGH
CLKIN High to BG High
22
ns
Notes:
1. DT = t
CK
- 50 ns
Memory Interface = PMA23-0, PMD47-0, PMS1-0, PMRD, PMWR, PMPAGE,
DMA31-0, DMD39-0, DMS3-0, DMRD, DMWR, DMPAGE.
Buses are not granted until completion of current memory access.
See the Memory Interface chapter of the
ADSP-21020 User’s Manual
from
Analog Devices for BG, BR cycle relationships.
2. Guaranteed by design.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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