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參數(shù)資料
| 型號： | UPD30181GM-66-8ED |
| 廠商： | NEC Corp. |
| 英文描述： | 64-/32-Bit Microprocessor |
| 中文描述： | 64-/32-Bit微處理器 |
| 文件頁數(shù)： | 434/444頁 |
| 文件大?。?/td> | 1449K |
| 代理商： | UPD30181GM-66-8ED |
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CHAPTER 23 COPROCESSOR 0 HAZARDS
User’s Manual U14272EJ3V0UM
434
(8) CACHE Index Store Tag
Source:
The confirmation of registers containing information necessary for executing this instruction.
(9) Coprocessor usable test
Source:
The confirmation of modes set by the bits of the CP0 registers in the “Source” column.
Examples 1.
After the contents of the CU0 bit of the Status register are modified, when accessing the CP0
registers in User mode or when executing an instruction such as TLB instructions, CACHE
instructions, or branch instructions that use the resource of the CP0.
2.
When accessing the CP0 registers in the operating mode set in the Status register after the
KSU, EXL, and ERL bits of the Status register are modified.
(10)Instruction fetch
Source:
The confirmation of the operating mode and TLB necessary for instruction fetch.
Examples 1.
When changing the operating mode from User to Kernel and fetching instructions after the KSU,
EXL, and ERL bits of the Status register are modified.
2.
When fetching instructions using the modified TLB entry after TLB modification.
(11)Instruction fetch exception
Destination: The completion of writing to registers containing information related to the exception when an
exception occurs on instruction fetch.
(12)Interrupts
Source:
The confirmation of registers judging the condition of occurrence of interrupt when an interrupt
factor is detected.
(13)Loads/sores
Source:
The confirmation of the operating mode related to the address generation of Load/Store
instructions, TLB entries, the cache mode set in the K0 bit of the Config register, and the registers
setting the condition of occurrence of a Watch exception.
Example
When Loads/Stores are executed in the kernel field after changing the mode from User to Kernel.
(14)Load/store exception
Destination: The completion of writing to registers containing information related to the exception when an
exception occurs on load or store operation.
(15)TLB shutdown
Destination: The completion of writing to the TS bit of the Status register when a TLB shutdown occurs.
相關PDF資料 |
PDF描述 |
|---|---|
| UPD3570 | UPD3570 2560-BIT CCD LINEAR IMAGE SENSOR |
| UPD3570D | UPD3570 2560-BIT CCD LINEAR IMAGE SENSOR |
| UPD3571 | 5000 BIT CCD LINEAR IMAGE SENSOR |
| UPD3571D | 5000 BIT CCD LINEAR IMAGE SENSOR |
| UPD3573 | 2048-BIT CCD LINEAR IMAGE SENSOR |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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| UPD30200 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:VR4300(TM).VR4305(TM).VR4310(TM) User＇s Manual | User＇s Manual[08/2000] |
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| UPD30200GD-80-LBB | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:64-Bit Microprocessor |
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