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參數(shù)資料
| 型號： | UPD44164185F5-E40-EQ1 |
| 廠商： | NEC Corp. |
| 英文描述： | 18M-BIT DDRII SRAM SEPARATE I/O 2-WORD BURST OPERATION |
| 中文描述： | 1800萬位條DDRII SRAM的分離I / O 2字爆發(fā)運作 |
| 文件頁數(shù)： | 3/32頁 |
| 文件大?。?/td> | 375K |
| 代理商： | UPD44164185F5-E40-EQ1 |
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3
Data Sheet M15823EJ7V
1
DS
μ
PD44164085, 44164185, 44164365
Pin Configurations
/
×××
indicates active low signal.
165-pin PLASTIC BGA (13 x 15)
(Top View)
[
μ
PD44164085F5-EQ1]
1
2
3
4
5
6
7
8
9
10
11
A
/CQ
V
SS
A
R, /W
/NW1
/K
NC
/LD
A
V
SS
CQ
B
NC
NC
NC
A
NC
K
/NW0
A
NC
NC
Q3
C
NC
NC
NC
V
SS
A
A
A
V
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NC
D3
D
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V
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V
SS
V
SS
V
SS
NC
NC
NC
E
NC
NC
Q4
V
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Q
V
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V
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V
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V
DD
Q
NC
D2
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V
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V
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V
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Q
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G
NC
D5
Q5
V
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Q
V
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H
/DLL
V
REF
V
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Q
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V
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V
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V
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V
REF
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J
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NC
NC
V
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V
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V
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V
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V
DD
Q
NC
Q1
D1
K
NC
NC
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V
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V
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V
SS
V
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V
DD
Q
NC
NC
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L
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Q6
D6
V
DD
Q
V
SS
V
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V
SS
V
DD
Q
NC
NC
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M
NC
NC
NC
V
SS
V
SS
V
SS
V
SS
V
SS
NC
NC
D0
N
NC
D7
NC
V
SS
A
A
A
V
SS
NC
NC
NC
P
NC
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Q7
A
A
C
A
A
NC
NC
NC
R
TDO
TCK
A
A
A
/C
A
A
A
TMS
TDI
A
D0 to D7
Q0 to Q7
/LD
R, /W
/NW0, /NW1
K, /K
C, /C
CQ, /CQ
ZQ
/DLL
: Address inputs
: Data inputs
: Data outputs
: Synchronous load
: Read Write input
: Nibble Write data select
: Input clock
: Output clock
: Echo clock
: Output impedance matching
: DLL disable
TMS
TDI
TCK
TDO
V
REF
V
DD
V
DD
Q
V
SS
NC
: IEEE 1149.1 Test input
: IEEE 1149.1 Test input
: IEEE 1149.1 Clock input
: IEEE 1149.1 Test output
: HSTL input reference input
: Power Supply
: Power Supply
: Ground
: No connection
Remark
Refer to
Package Drawing
for the index mark.
相關(guān)PDF資料 |
PDF描述 |
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