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參數(shù)資料
| 型號： | UPD45128841G5-A80 |
| 廠商： | NEC Corp. |
| 英文描述： | 128M-bit Synchronous DRAM 4-bank, LVTTL |
| 中文描述： | 128兆位同步DRAM 4銀行，LVTTL |
| 文件頁數(shù)： | 20/92頁 |
| 文件大?。?/td> | 1107K |
| 代理商： | UPD45128841G5-A80 |
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Data Sheet M12650EJBV0DS00
20
μ
PD45128441, 45128841, 45128163
5. Initialization
The synchronous DRAM is initialized in the power-on sequence according to the following.
(1)
To stabilize internal circuits, when power is applied, a 100
μ
s or longer pause must precede any signal toggling.
(2)
After the pause, all banks must be precharged using the Precharge command (The Precharge all banks
command is convenient).
(3)
Once the precharge is completed and the minimum t
RP
is satisfied, the mode register can be programmed.
After the mode register set cycle, t
RSC
(2 CLK minimum) pause must be satisfied as well.
(4)
Two or more CBR (Auto) refresh must be performed.
Remarks 1.
The sequence of Mode register programming and Refresh above may be transposed.
2.
CKE and DQM must be held high until the Precharge command is issued to ensure data-bus Hi-Z.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD45128841G5-A80-9JF | 128M-bit Synchronous DRAM 4-bank, LVTTL |
| UPD45128163G5-A10B | 128M-bit Synchronous DRAM 4-bank, LVTTL |
| UPD45128163G5-A10B-9JF | 128M-bit Synchronous DRAM 4-bank, LVTTL |
| UPD45128163G5-A75 | 128M-bit Synchronous DRAM 4-bank, LVTTL |
| UPD45128163G5-A75-9JF | 128M-bit Synchronous DRAM 4-bank, LVTTL |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD4516161AG5A109NF | 制造商:NEC Electronics Corporation 功能描述: |
| UPD4516161AG5-A10-9NF | 制造商:NEC Electronics Corporation 功能描述:SDRAM, 1M x 16, 50 Pin, Plastic, TSOP |
| UPD4528BC | 制造商:Panasonic Industrial Company 功能描述:IC |
| UPD4528C | 制造商:Panasonic Industrial Company 功能描述:IC SUB:TC4528BP OR TVSTC4528BP |
| UPD4564163G5-A10B-9JF | 制造商:NEC Electronics Corporation 功能描述:SDRAM, 4M x 16, 54 Pin, Plastic, TSOP |
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