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參數(shù)資料
| 型號： | UPD46128512F9-CR2 |
| 廠商： | NEC Corp. |
| 英文描述： | 128M-BIT CMOS MOBILE SPECIFIED RAM 8M-WORD BY 16-BIT EXTENDED TEMPERATURE OPERATION |
| 中文描述： | 128兆位CMOS移動指明內(nèi)存800萬字由16位溫度范圍 |
| 文件頁數(shù)： | 49/82頁 |
| 文件大?。?/td> | 817K |
| 代理商： | UPD46128512F9-CR2 |
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Preliminary Data Sheet M17507EJ2V0DS
49
μ
PD46128512-X
Figure 7-17. Asynchronous Write Cycle Timing Chart 7 (/LB, /UB Independent Controlled 1)
t
WC
t
AS
t
WC
t
AS
A1
A2
A3
t
WR
t
WR
t
DW
t
DH
t
DW
t
DH
t
BW
t
BW
t
ASO
/OE (Input)
t
OHAH
t
OES
t
OEH
t
BP
/CE1 (Input)
Address (Input)
DQ0 to DQ7 (Input)
High-Z
High-Z
High-Z
High-Z
/WE (Input)
/LB (Input)
/UB (Input)
DQ8 to DQ15 (Input)
L
Data In D2
Data In D1
Cautions 1. During address transition, at least one of pins /CE1 and /WE, or both of /LB and /UB pins should
be inactivated.
2. Do not input data to the DQ pins while they are in the output state.
3. In write cycle, CE2 and /OE should be fixed HIGH.
4. /ADV should be fixed LOW or toggled HIGH
→
LOW
→
HIGH. CLK should be fixed HIGH or LOW.
Remark
Write operation is done during the overlap time of LOW of following signals.
/CE1
/WE
/LB and/or /UB
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