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參數(shù)資料
| 型號： | UPD75312BGC |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 4位單片機(jī) |
| 文件頁數(shù)： | 59/77頁 |
| 文件大?。?/td> | 587K |
| 代理商： | UPD75312BGC |
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59
μ
PD75312B, 75316B
SBI mode (SCK...Internal clock output (master)): (Ta = –40 to +85
°
C , V
DD
= 2.0 to 6.0 V )
V
DD
= 4.5 to 6.0 V
1600
ns
3800
ns
V
DD
= 4.5 to 6.0 V
t
KCY3
/2–50
ns
t
KCY3
/2–150
ns
250
ns
t
KCY3
/2
ns
V
DD
= 4.5 to 6.0 V
0
250
ns
0
1000
ns
t
KCY3
ns
t
KCY3
ns
t
KCY3
ns
t
KCY3
ns
t
KCY3
t
KL3
t
KH3
t
SIK3
t
KSI3
t
KSO3
SCK cycle time
SB0 and SB1 setup time (to SCK
↑
)
SB0 and SB1 hold time (from SCK
↑
)
SB0 and SB1 output
delay time from SCK
↓
SCK high- and low-level
widths
SB0, SB1
↓
from SCK
↑
SCK from SB0, SB1
↓
SB0 and SB1 low-level widths
SB0 and SB1 high-level widths
t
KSB
t
SBK
t
SBL
t
SBH
*
R
L
and C
L
are SB0, SB1 output line load resistance and load capacitance, respectively.
SBI mode (SCK...External clock input (slave)): (Ta = –40 to +85
°
C , V
DD
= 2.0 to 6.0 V )
V
DD
= 4.5 to 6.0 V
800
ns
3200
ns
V
DD
= 4.5 to 6.0 V
400
ns
1600
ns
100
ns
t
KCY4
/2
ns
V
DD
= 4.5 to 6.0 V
0
300
ns
0
1000
ns
t
KCY4
ns
t
KCY4
ns
t
KCY4
ns
t
KCY4
ns
t
KCY4
t
KL4
t
KH4
t
SIK4
t
KSI4
t
KSO4
SCK cycle time
SB0 and SB1 setup time (to SCK
↑
)
SB0 and SB1 hold time (from SCK
↑
)
SB0 and SB1 output
delay time from SCK
↓
SCK high- and low-level
widths
SB0, SB1
↓
from SCK
↑
SCK
from SB0, SB1
↓
SB0 and SB1 low-level widths
SB0 and SB1 high-level widths
t
KSB
t
SBK
t
SBL
t
SBH
*
R
L
and C
L
are SB0, SB1 output line load resistance and load capacitance, respectively.
PARAMETER
SYMBOL
TEST CONDITIONS
MIN.
TYP.
MAX.
UNIT
PARAMETER
SYMBOL
TEST CONDITIONS
MIN.
TYP.
MAX.
UNIT
R
L
= 1 k
, C
L
= 100 pF
*
R
L
= 1 k
, C
L
= 100 pF
*
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD75312BGK | 4-BIT SINGLE-CHIP MICROCOMPUTER |
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| UPD75312 | 4-BIT SINGLE-CHIP MICROCOMPUTER |
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參數(shù)描述 |
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