參數(shù)資料
型號： uPSD3412C-40U6T
廠商： 意法半導(dǎo)體
英文描述： 320 x 240 pixel format, CFL backlight available with power harness
中文描述： 閃存可編程系統(tǒng)設(shè)備與8032微控制器核心和16Kbit SRAM的
文件頁數(shù)： 99/152頁
文件大?。?/td> 1558K
代理商： UPSD3412C-40U6T
99/152
UPSD3212C, UPSD3212CV
Decode PLD (DPLD)
The DPLD, shown in Figure 49, is used for decod-
ing the address for PSD MODULE and external
components. The DPLD can be used to generate
the following decode signals:
– 4 Sector Select (FS0-FS3) signals for the prima-
ry Flash memory (three product terms each)
– 2 Sector Select (CSBOOT0-CSBOOT1) signals
for the secondary Flash memory (three product
terms each)
– 1 internal SRAM Select (RS0) signal (two prod-
uct terms)
– 1 internal CSIOP Select signal (selects the PSD
MODULE registers)
– 2 internal Peripheral Select signals (Peripheral
I/O Mode).
Figure 49. DPLD Logic Array
Note: 1. Port A inputs are not available in the 52-pin package
2. Inputs from the MCU module
(INPUTS)
(20)
(8)
(16)
(1)
PDN (APD OUTPUT)
I/O PORTS (PORT A,B,C)1
(8)
PGR0 -PGR7
(8)
MCELLAB.FB [7:0] (FEEDBACKS)
MCELLBC.FB [7:0] (FEEDBACKS)
A[15:0]2
(2)
(4)
PD[2:1]
PSEN, RD, WR, ALE2
(1)
(1)
RESET 2
RD_BSY
RS0
CSIOP
PSEL0
PSEL1
4 PRIMARY FLASH
MEMORY SECTOR
SELECTS
SRAM SELECT
I/O DECODER
SELECT
PERIPHERAL I/O
MODE SELECT
CSBOOT 0
CSBOOT 1
FS0
3
3
3
3
3
3
2
AI07436
FS1
FS2
FS3
1
1
1
相關(guān)PDF資料
PDF描述
UPSD3433EV-40U6 Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic
UR132-26-AE3-5-R 200mA LOW DROPOUT LINEAR VOLTAGE REGULATOR
URS1A101MRD ALUMINUM ELECTROLYTIC CAPACITORS
URU1V470MRD ALUMINUM ELECTROLYTIC CAPACITORS
URZ1A101MPD ALUMINUM ELECTROLYTIC CAPACITORS
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參數(shù)描述
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