參數資料
| 型號： | XC4020XL-3PQ240I |
| 廠商： | Xilinx Inc |
| 文件頁數： | 44/68頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA I-TEMP 3.3V 3SPD 240PQFP |
| 產品變化通告： | XC4000XL/E, XC9500XV, XC3100A Discontinuance 12/Apr/2010 |
| 標準包裝： | 1 |
| 系列： | XC4000E/X |
| LAB/CLB數： | 784 |
| 邏輯元件/單元數： | 1862 |
| RAM 位總計： | 25088 |
| 輸入/輸出數： | 192 |
| 門數： | 20000 |
| 電源電壓： | 3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 240-BFQFP |
| 供應商設備封裝： | 240-PQFP（32x32） |
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R
May 14, 1999 (Version 1.6)
6-53
XC4000E and XC4000X Series Field Programmable Gate Arrays
6
XC4000E/X
UCLK_SYNC
XC4000E/X
UCLK_NOSYNC
XC4000E/X
CCLK_SYNC
XC4000E/X
CCLK_NOSYNC
XC3000
XC2000
CCLK
GSR Active
UCLK Period
DONE IN
Di
Di+1
Di+2
Di
Di+1
Di+2
U2
U3
U4
U2
U3
U4
U2
U3
U4
C1
Synchronization
Uncertainty
Di
Di+1
Di
Di+1
DONE
I/O
GSR Active
DONE
I/O
GSR Active
DONE
C1
C2
C1
U2
C3
C4
C2
C3
C4
C2
C3
C4
I/O
GSR Active
DONE
I/O
DONE
Global Reset
I/O
DONE
Global Reset
I/O
F = Finished, no more
configuration clocks needed
Daisy-chain lead device
must have latest F
Heavy lines describe
default timing
CCLK Period
Length Count Match
F
X9024
C1, C2 or C3
Figure 47: Start-up Timing
Product Obsolete or Under Obsolescence
相關PDF資料 |
PDF描述 |
|---|---|
| XC4020XL-3PQ240C | IC FPGA C-TEMP 3.3V 3SPD 240PQFP |
| ABB106DHBT-S621 | CONN EDGECARD 212PS R/A .050 SLD |
| ACB106DHBT-S621 | EDGECARD 212POS DIP R/A .050 SLD |
| MC8641DTVU1333JE | IC MPU DUAL CORE E600 1023FCCBGA |
| MC7457TRX1000NC | IC MPU RISC 32BIT 483FCCBGA |
相關代理商/技術參數 |
參數描述 |
|---|---|
| XC4020XLA-07PQ160C | 制造商:Xilinx 功能描述: |
| XC4020XLA-08BG256C | 制造商:Rochester Electronics LLC 功能描述: 制造商:Xilinx 功能描述:FPGA, 784 CLBS, 13000 GATES, 263 MHz, 256 Pin Plastic BGA |
| XC4020XLA-09BG256C | 制造商:Rochester Electronics LLC 功能描述: 制造商:Xilinx 功能描述: |
| XC4020XLA09C-BG256AKP | 制造商:Xilinx 功能描述: |
| XC4020XLA-09PQ160C | 制造商:Xilinx 功能描述: |
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