參數(shù)資料
型號(hào)： XCV200E-7CS144C
廠商： Xilinx Inc
文件頁(yè)數(shù)： 5/233頁(yè)
文件大小： 0K
描述： IC FPGA 1.8V C-TEMP 144-CSBGA
產(chǎn)品變化通告： FPGA Family Discontinuation 18/Apr/2011
標(biāo)準(zhǔn)包裝： 198
系列： Virtex®-E
LAB/CLB數(shù)： 1176
邏輯元件/單元數(shù)： 5292
RAM 位總計(jì)： 114688
輸入/輸出數(shù)： 94
門(mén)數(shù)： 306393
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 144-TFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 144-LCSBGA（12x12）
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
Module 4 of 4
DS022-4 (v3.0) March 21, 2014
16
Production Product Specification
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
HQ240 Differential Pin Pairs
Virtex-E devices have differential pin pairs that can also pro-
vide other functions when not used as a differential pair. A
√
in the AO column indicates that the pin pair can be used as
an asynchronous output for all devices provided in this
package. Pairs with a note number in the AO column are
device dependent. They can have asynchronous outputs if
the pin pair are in the same CLB row and column in the
device. Numbers in this column refer to footnotes that indi-
cate which devices have pin pairs than can be asynchro-
nous outputs. The Other Functions column indicates
alternative function(s) not available when the pair is used as
a differential pair or differential clock.
Table 9: HQ240 Differential Pin Pair Summary
XCV600E, XCV1000E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
Global Differential Clock
0
4
P92
P93
NA
IO _DLL_L40P
1
5
P89
P87
NA
IO _DLL_L40N
2
1
P210
P209
NA
IO _DLL_L6P
3
0
P213
P215
NA
IO _DLL_L6N
IO LVDS
Total Pairs: 64, Asynchronous Output Pairs: 53
0
P236
P237
NA
VREF
1
0
P234
P235
√
-
2
0
P228
P229
√
VREF
3
0
P223
P224
√
-
4
0
P220
P221
√
-
5
0
P217
P218
√
VREF
6
1
P209
P215
NA
IO_LVDS_DLL
7
1
P205
P206
√
VREF
8
1
P202
P203
√
-
9
1
P199
P200
√
-
10
1
P194
P195
√
VREF
11
1
P191
P192
√
VREF
12
1
P188
P189
√
-
13
1
P186
P187
NA
VREF
14
1
P184
P185
√
CS
15
2
P178
P177
√
DIN, D0
16
2
P174
P173
√
-
17
2
P171
P170
√
VREF
18
2
P168
P167
√
D1
19
2
P163
P162
√
D2
20
2
P160
P159
√
-
21
2
P157
P156
√
D3
22
2
P155
P154
1
VREF
23
2
P153
P152
√
-
24
3
P145
P144
√
D4, VREF
25
3
P142
P141
√
-
26
3
P139
P138
√
D5
27
3
P134
P133
√
VREF
28
3
P131
P130
√
VREF
29
3
P128
P127
√
-
30
3
P126
P125
1
VREF
31
3
P124
P123
√
INIT
32
4
P118
P117
√
-
33
4
P114
P113
√
-
34
4
P111
P110
√
VREF
35
4
P108
P107
√
VREF
36
4
P103
P102
√
-
37
4
P100
P99
√
-
38
4
P97
P96
√
VREF
39
4
P95
P94
NA
VREF
40
5
P93
P87
NA
IO_LVDS_DLL
41
5
P84
P82
NA
VREF
42
5
P79
P78
√
-
43
5
P74
P73
√
VREF
44
5
P71
P70
√
VREF
45
5
P68
P67
√
-
46
5
P66
P65
NA
VREF
47
5
P64
P63
√
-
Table 9: HQ240 Differential Pin Pair Summary
XCV600E, XCV1000E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
相關(guān)PDF資料
PDF描述
XCV200E-6CS144I IC FPGA 1.8V I-TEMP 144-CSBGA
XCV200E-6FG256C IC FPGA 1.8V C-TEMP 256-FBGA
4-745130-4 SHLDING FERRULE,PLTD,BULK PKG
XA6SLX45T-3FGG484Q IC FPGA SPARTAN 6 484FGGBGA
XA6SLX75T-3FGG484I IC FPGA SPARTAN 6 74K 484FGGBGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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XCV200E-7FG240C 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays
XCV200E-7FG240I 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays
XCV200E-7FG256C 功能描述:IC FPGA 1.8V C-TEMP 256-FBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列） 系列:Virtex®-E 產(chǎn)品變化通告:Step Intro and Pkg Change 11/March/2008 標(biāo)準(zhǔn)包裝:1 系列:Virtex®-5 SXT LAB/CLB數(shù):4080 邏輯元件/單元數(shù):52224 RAM 位總計(jì):4866048 輸入/輸出數(shù):480 門(mén)數(shù):- 電源電壓:0.95 V ~ 1.05 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:1136-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:1136-FCBGA 配用:568-5088-ND - BOARD DEMO DAC1408D750122-1796-ND - EVALUATION PLATFORM VIRTEX-5
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