參數(shù)資料
型號(hào)： XIO2200AGGW
廠商： Texas Instruments
文件頁(yè)數(shù)： 19/202頁(yè)
文件大?。?/td> 0K
描述： IC PCI-EXPRESS/BUS BRIDGE 176BGA
產(chǎn)品培訓(xùn)模塊： PCI Express Basics
標(biāo)準(zhǔn)包裝： 126
應(yīng)用： PCI Express 至 PCI 轉(zhuǎn)換橋
接口： PCI
電源電壓： 1.35 V ~ 1.65 V，3 V ~ 3.6 V
封裝/外殼： 176-LFBGA
供應(yīng)商設(shè)備封裝： 176-BGA MICROSTAR（15x15）
包裝： 托盤
安裝類型： 表面貼裝
產(chǎn)品目錄頁(yè)面： 882 (CN2011-ZH PDF)
配用： XIO2200AEVM-ND - XIO2200AEVM
其它名稱： 296-19617
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Memory-Mapped TI Proprietary Register Space
102
March 5 2007 June 2011
SCPS154C
6
Memory-Mapped TI Proprietary Register Space
The programming model of the memory-mapped TI proprietary register space is unique to this device. These
custom registers are specifically designed to provide enhanced features associated with upstream
isochronous applications.
All bits marked with a k are sticky bits and are reset by a global reset (GRST) or the internally-generated
power-on reset. All bits marked with a are reset by a PCI Express reset (PERST), a GRST, or the
internally-generated power-on reset. The remaining register bits are reset by a PCI Express hot reset, PERST,
GRST, or the internally-generated power-on reset.
Table 61. Device Control Memory Window Register Map
REGISTER NAME
OFFSET
Upstream isochrony capabilities
Revision ID
Device control map ID
00h
Reserved
Upstream isochrony control
04h
Reserved
Upstream isochronous window 0 control
08h
Upstream isochronous window 0 base address
0Ch
Upstream isochronous window 0 limit
10h
Reserved
Upstream isochronous window 1 control
14h
Upstream isochronous window 1 base address
18h
Upstream isochronous window 1 limit
1Ch
Reserved
Upstream isochronous window 2 control
20h
Upstream isochronous window 2 base address
24h
Upstream isochronous window 2 limit
28h
Reserved
Upstream isochronous window 3 control
2Ch
Upstream isochronous window 3 base address
30h
Upstream isochronous window 3 limit
34h
Reserved
38h3Ch
GPIO data
GPIO control
40h
Serial-bus control and status
Serial-bus slave address
Serial-bus word address
Serial-bus data
44h
TI proprietary
Reserved
TI proprietary
48h
Reserved
TI proprietary
4Ch
One or more bits in this register are reset by a PCI Express reset (PERST), a GRST, or the internally-generated power-on reset.
6.1
Device Control Map ID Register
The device control map ID register identifies the TI proprietary layout for this device control map. The value
01h identifies this as a PCI Express-to-PCI bridge supporting upstream isochronous capabilities.
Device control memory window register offset:
00h
Register type:
Read-only
Default value:
01h
BIT NUMBER
7
6
5
4
3
2
1
0
RESET STATE
0
1
6.2
Revision ID Register
The revision ID register identifies the revision of the TI proprietary layout for this device control map. The value
00h identifies the revision as the initial layout.
Device control memory window register offset:
01h
Register type:
Read-only
Default value:
00h
BIT NUMBER
7
6
5
4
3
2
1
0
RESET STATE
0
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PDF描述
XIO2200AZGW IC PCI-EXPRESS/BUS BRIDGE 176BGA
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XIO2200AZGW 制造商:Texas Instruments 功能描述:PCI Express to PCI Bus Converter IC
XIO2200AZHH 功能描述:外圍驅(qū)動(dòng)器與原件 - PCI PCI Exp-PCI Bus Trans Bridge RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray
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