參數資料
型號： XRD9825EVAL
廠商： Exar Corporation
文件頁數： 7/33頁
文件大小： 0K
描述： EVAL BOARD FOR XRD9825
標準包裝： 1
系列： *
XRD9825
15
Rev. 1.00
CIS Mode Timing -- AC Coupled
(CLAMP enabled)
ADCCLK
tckhw
tcklw
tckpd
tap
Pixel N-1
Pixel N
tdv
Pixel N+1
CIS
tdv
[5:0]
[11:6]
N-8
LSB
N-7
LSB
N-6
LSB
N-5
LSB
CLAMP
tclpw
MSB
DB
Figure 9. Timing Diagram for Figure 8
ADCCLK
Events
↓
ADC Sample & PGA Start Track of next Pixel
MSB Data Out (8 Upper Bits)
↑
LSB Data Out (8 Lower Bits)
HI
ADC Track PGA Output
LO
ADC Hold/Convert
Table 3.
CLAMP
Events
HI
PGA Tracks V
CLAMP & CEXT is Charged to
V
BLACK - VCLAMP, which is equal to VBLACK
LO
PGA Tracks VIN
PP
Table 4.
Note: There is an 8 clock latency for the output
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