參數(shù)資料
型號： XRT72L56IB
廠商： EXAR CORP
元件分類： 數(shù)字傳輸電路
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： DATACOM, FRAMER, PBGA388
封裝： 35 X 35 MM, PLASTIC, BGA-388
文件頁數(shù)： 3/486頁
文件大?。?/td> 2733K
代理商： XRT72L56IB
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á
XRT72L56
SIX CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
PRELIMINARY
REV. P1.1.2
I
TABLE OF CONTENTS
GENERAL DESCRIPTION ............................................................................................... 1
FEATURES
................................................................................................................................................. 1
APPLICATIONS
........................................................................................................................................... 1
Figure 1. Block Diagram of the XRT72L56 ........................................................................................... 1
Figure 2. Pin Out of the XRT72L56 & 58 ............................................................................................... 2
ORDERING INFORMATION ............................................................................................ 2
PIN DESCRIPTION .......................................................................................................... 3
ELECTRICAL CHARACTERISTICS .............................................................................. 29
A
BSOLUTE
M
AXIMUMS
............................................................................................................................. 29
DC E
LECTRICAL
C
HARACTERISTICS
......................................................................................................... 29
AC E
LECTRICAL
C
HARACTERISTICS
......................................................................................................... 29
AC E
LECTRICAL
C
HARACTERISTICS
(C
ONT
.) ............................................................................................ 31
1.0 Timing Diagrams ................................................................................................................................. 36
Figure 3. Timing Diagram for Transmit Payload Input Interface, when the XRT72L56 Device is operating in
both the DS3 and Loop-Timing Modes ................................................................................................. 36
Figure 4. Timing Diagram for the Transmit Payload Input Interface, when the XRT72L56 Device is operating
in both the DS3 and Local-Timing Modes ............................................................................................. 36
Figure 5. Timing Diagram for the Transmit Payload Data Input Interface, when the XRT72L56 Device is
operating in both the DS3/Nibble and Looped-Timing Modes .............................................................. 37
Figure 6. Timing Diagram for the Transmit Payload Data Input Interface, when the XRT72L56 Device is
operating in the DS3/Nibble and Local-Timing Modes .......................................................................... 37
Figure 7. Timing Diagram for the Transmit Overhead Data Input Interface (Method 1 Access) .......... 38
Figure 8. Timing Diagram for the Transmit Overhead Data Input Interface (Method 2 Access) .......... 38
Figure 9. Transmit LIU Interface Timing - Framer is configured to update "TxPOS" and "TxNEG" on the
rising edge of "TxLineClk" ..................................................................................................................... 39
Figure 10. Transmit LIU Interface Timing - Framer is configured to update "TxPOS" and "TxNEG" on the
falling edge of "TxLineClk" .................................................................................................................... 39
Figure 11. Receive LIU Interface Timing - Framer is configured to sample "RxPOS" and "RxNEG" on the
rising edge of "RxLineClk" ..................................................................................................................... 40
Figure 12. Receiver LIU Interface Timing - Framer is configured to sample "RxPOS" and "RxNEG" on the
falling edge of "RxLineClk" .................................................................................................................... 40
Figure 13. Receive Payload Data Output Interface Timing .................................................................. 41
Figure 14. Receive Payload Data Output Interface Timing (Nibble Mode Operation) ......................... 41
Figure 15. Receive Overhead Data Output Interface Timing (Method 1 - Using RxOHClk) ................ 42
Figure 16. Receive Overhead Data Output Interface Timing (Method 2 - Using RxOHEnable) .......... 42
Figure 17. Microprocessor Interface Timing - Intel Type Programmed I/O Read Operations .............. 43
Figure 18. Microprocessor Interface Timing - Intel Type Programmed I/O Write Operations .............. 43
Figure 19. Microprocessor Interface Timing - Intel Type Read Burst Access Operation ..................... 44
Figure 20. Microprocessor Interface Timing - Intel Type Write Burst Access Operation ..................... 44
Figure 21. Microprocessor Interface Timing - Motorola Type Programmed I/O Read Operation ........ 45
Figure 22. Microprocessor Interface Timing - Motorola Type Programmed I/O Write Operation ......... 45
Figure 23. Microprocessor Interface Timing - Reset Pulse Width ........................................................ 46
2.0 The Microprocessor Interface Block ................................................................................................. 47
2.1 C
HANNEL
S
ELECTION
WITHIN
THE
XRT72L56 D
EVICE
.......................................................................................... 47
T
ABLE
1: T
HE
R
ELATIONSHIP
BETWEEN
A
DDRESS
B
ITS
A9, A10
AND
A11
THE
S
ELECTED
C
ONFIGURATION
R
EG
-
ISTER
B
ANK
............................................................................................................................................ 47
Figure 24. Simple Block Diagram of the Microprocessor Interface Block, within the Framer IC .......... 48
2.2 T
HE
M
ICROPROCESSOR
I
NTERFACE
B
LOCK
S
IGNAL
.............................................................................................. 48
T
ABLE
2: D
ESCRIPTION
OF
THE
M
ICROPROCESSOR
I
NTERFACE
S
IGNALS
THAT
EXHIBIT
CONSTANT
ROLES
IN
BOTH
THE
I
NTEL
AND
M
OTOROLA
M
ODES
.......................................................................................................... 49
T
ABLE
3: P
IN
D
ESCRIPTION
OF
M
ICROPROCESSOR
I
NTERFACE
S
IGNALS
- W
HILE
THE
M
ICROPROCESSOR
I
NTER
-
FACE
IS
O
PERATING
IN
THE
I
NTEL
M
ODE
.................................................................................................. 49
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PDF描述
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XRT72L58ES-PCI 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
XRT72L58IB 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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XRT72L71ES-00PCI 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T73LC00A+T71D00 RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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