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參數(shù)資料
| 型號： | XWM9708CDS |
| 廠商： | Wolfson Microelectronics |
| 元件分類： | Codec |
| 英文描述： | AC97 Revision 2.1 Audio Codec |
| 中文描述： | AC97音頻編解碼器2.1版 |
| 文件頁數(shù)： | 8/28頁 |
| 文件大?。?/td> | 205K |
| 代理商： | XWM9708CDS |
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WM9708
WARM RESET
Advanced Information
WOLFSON MICROELECTRONICS LTD
AI Rev 2.0 April 2001
8
SYNC
BITCLK
t
SYNC_HIGH
t
SYNC2CLK
Figure 3 Warm Reset Timing
PARAMETER
SYMBOL
t
SYNC_HIGH
t
SYNC2_CLK
MIN
TYP
1.3
MAX
UNIT
μ
s
ns
SYNC active high pulse width
SYNC release (or falling edge) to
BITCLK startup delay
162.4
CLOCK SPECIFICATIONS
BITCLK
SYNC
t
CLK_HIGH
t
CLK_LOW
t
CLK_PERIOD
t
SYNC_HIGH
t
SYNC_LOW
t
SYNC_PERIOD
Figure 4 Clock Specifications (50pF External Load)
PARAMETER
BITCLK frequency
BITCLK period
BITCLK output jitter
BITCLK high pulse width
(See Note)
BITCLK low pulse width
(See Note)
SYNC frequency
SYNC period
SYNC high pulse width
SYNC low pulse width
Note:
Worst case duty cycle restricted to 40/60.
SYMBOL
MIN
TYP
12.288
81.4
MAX
UNIT
MHz
ns
ps
ns
t
CLK_PERIOD
750
48.84
t
CLK_HIGH
32.56
40.7
t
CLK_LOW
32.56
40.7
48.84
ns
48.0
20.8
1.3
19.5
kHz
μ
s
μ
s
μ
s
t
SYNC_PERIOD
t
SYNC_HIGH
t
SYNC_LOW
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