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參數資料
| 型號： | 79RC32V333-133DHI |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數： | 530/654頁 |
| 文件大?。?/td> | 6963K |
| 代理商： | 79RC32V333-133DHI |
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IDT EJTAG System
EJTAG Test Access Port
79RC32438 User Reference Manual
20 - 64
November 4, 2002
Notes
The contents of the Data register are not aligned but hold data as it is seen on a data bus for an external
memory system. Thus the bytes are positioned in the Data register based on access size, address, and
endianess. The bytes not accessed for a processor access write are undefined, and the bytes not accessed
for a processor access read can be written with any value by the probe shifting the value into the Data
register.
Table 20.46 shows the byte positioning for a 32-bit processor (MIPS32/64 = 0), in which case the two
LSBs of the Address register are used. Byte 0 refers to bits 7:0, byte 1 refers to bits 15:8, byte 2 refers to
bits 23:16, and byte 3 refers to bits 31:24, independent of endianess.
Address Register (TAP Instruction ADDRESS or ALL)
Compliance Level
: Required with EJTAG TAP feature.
The read-only Address register provides the address for a processor access. The width of the register
corresponds to the size of the physical address in the processor implementation (from 32 to 64 bits). The
specific length is determined by shifting through the Address register, because the length is not indicated
elsewhere. The value read in the register is valid if a processor access is pending, otherwise the value is
undefined. The two or three LSBs of the register are used with the Psz field from the EJTAG Control
register to indicate the size and data position of the pending processor access transfer. These bits are not
taken directly from the address referenced by the load/store.
Figure 20.31 shows the format of the Address register and Table 20.47 describes the Address register
field.
Fields
Description
Read/
Write
Reset
State
Compli-
ance
Name
Bit
Data
MSB:0
Data used by processor access.
R/W
Undefined
Required
Table 20.45 Data Register Field Description
Psz
from
ECR
Size
Address[1:
0]
Little
Endian
Big Endian
3
2
1
0
3
2
1
0
0
Byte
00
2
01
2
10
2
11
2
1
Halfword
00
2
10
2
2
Word
00
2
3
Triple
00
2
01
2
Reserved
n.a.
n.a.
Table 20.46 Data Register Contents for 32-bit Processors
相關PDF資料 |
PDF描述 |
|---|---|
| 79RC32V333-150DH | 8 PIN, 1.75KB, FLASH, 64B RAM, COMPARATOR, 8MHZ INTERNAL OSCILLATOR, -40C to +125C, 8-PDIP, TUBE |
| 79RC32V333-150DHI | Microprocessor |
| 79RC32V334-100BB | MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
| 79RC32V334-100BBI | MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
| 79RC32V334-133BB | MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
相關代理商/技術參數 |
參數描述 |
|---|---|
| 79RC32V333-150DH | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V333-150DHI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V334-100BB | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
| 79RC32V334-100BBG | 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 32-Bit 100MHz 3.3V 256-Pin BGA |
| 79RC32V334-100BBGI | 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 32-Bit 100MHz 3.3V 256-Pin BGA |
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