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參數(shù)資料
| 型號： | 82860 |
| 英文描述： | Controller Miscellaneous - Datasheet Reference |
| 中文描述： | 控制器雜項-數(shù)據(jù)表參考 |
| 文件頁數(shù)： | 38/211頁 |
| 文件大?。?/td> | 1099K |
| 代理商： | 82860 |
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Signal Description
R
38
Intel
82860 MCH Datasheet
Signal Name
Type
Description
G_AD[31:0]
I/O
AGP
Address/Data Bus:
During PIPE# and FRAME# Operation:
G_AD[31:0] are used to transfer
both address and data information on the AGP interface.
During SBA Operation:
G_AD[31:0] are used to transfer data on the AGP
interface.
G_C/BE[3:0]#
I/O
AGP
Command/Byte Enable:
During FRAME# Operation:
During the address phase of a transaction,
G_C/BE[3:0]# define the Bus command. During the data phase,
G_C/BE[3:0]# are used as byte enables. The byte enables determine which
byte lanes carry meaningful data. The commands issued on the
G_C/BE[3:0]# signals during FRAME# based AGP are the same
C/BE[3:0]# command described in the PCI 2.1 specification.
During PIPE# Operation:
When an address is enqueued using PIPE#, the
G_C/BE[3:0]# signals carry command information. Refer to the
AGP 2.0
Interface Specification, Revision 2.0
for the definition of these commands.
The command encoding used during PIPE# based AGP is
Different
than
the command encoding used during FRAME# based AGP cycles (or
standard PCI cycles on a PCI bus).
During SBA Operation:
Not used.
G_PAR
AGP
Parity:
During FRAME# Operation:
This signal is driven by the MCH when it acts
as a FRAME#-based AGP initiator during address and data phases for a
write cycle, and during the address phase for a read cycle. G_PAR is driven
by the MCH when it acts as a FRAME# based AGP target during each data
phase of a FRAME# based AGP memory read cycle. Even parity is
generated across G_AD[31:0] and G_C/BE[3:0]#.
During SBA and PIPE# Operation:
This signal is not used during SBA
and PIPE# operation.
G_SERR#
I
AGP
SERR#:
The G_SERR# signal is used by a PCI device to signal an error on
a PCI device attached to AGP/PCI. The MCH may be configured to send a
SERR message to the ICH2 upon the assertion of G_SERR#.
NOTE:
PCIRST# from the ICH2 is connected to RSTIN# and is used to reset AGP interface logic within the
MCH. The AGP agent will also use PCIRST# provided by the ICH2 as an input to reset its internal
logic. The LOCK# signal is
not supported
on the AGP interface (even for PCI operations). PERR#
signal is
not supported
on the AGP interface.
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PDF描述 |
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