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參數(shù)資料
| 型號(hào)： | 82860 |
| 英文描述： | Controller Miscellaneous - Datasheet Reference |
| 中文描述： | 控制器雜項(xiàng)-數(shù)據(jù)表參考 |
| 文件頁數(shù)： | 48/211頁 |
| 文件大?。?/td> | 1099K |
| 代理商： | 82860 |
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Register Description
R
48
Intel
82860 MCH Datasheet
the configuration point of view. Routing of configuration accesses to Hub Interface_B–C and AGP
is controlled via the standard PCI-PCI bridge mechanism using information contained within the
Primary Bus Number, the Secondary Bus Number, and the Subordinate Bus Number registers of
the corresponding PCI-PCI bridge device.
Logical PCI BUS #0 Configuration Mechanism
The MCH checks the Bus Number (bits 23:16) and the Device Number fields of the
CONF_ADDR register. If the Bus Number field of CONF_ADDR is 0, the configuration cycle is
targeting a PCI Bus #0 device.
The Host-Hub Interface_A Bridge entity within the MCH is hardwired as Device 0 on
PCI Bus #0.
The Host-AGP Bridge entity within the MCH is hardwired as Device 1 on PCI Bus #0.
The Host-Hub Interface_B bridge entity within the MCH is hardwired as Device 2 on
PCI Bus #0.
The Host-Hub Interface_C bridge entity within the MCH is hardwired as Device 3 on
PCI Bus #0.
Configuration cycles to any of the MCH’s internal devices are confined to the MCH and not sent
over Hub Interface_A. Accesses to disabled MCH internal devices, or devices #7 to #31 will be
forwarded over Hub Interface_A as Type 0 configuration cycles.
Primary PCI and Downstream Configuration Mechanism
If the Bus Number in the CONF_ADDR is non-zero, and is less than the values programmed into
any of the internal MCH device’s Secondary Bus Number registers or greater than the values
programmed into the Subordinate Bus Number registers, the MCH will generate a Type 1 Hub
Interface_A Configuration Cycle. The ICH2 compares the non-zero Bus Number with the
Secondary Bus Number and Subordinate Bus Number registers of its P2P bridges to determine if
the configuration cycle is meant for Primary PCI or a downstream PCI bus.
AGP Bus Configuration Mechanism
From the chipset configuration perspective, AGP is seen as PCI bus interfaces residing on a
Secondary Bus side of the “virtual” PCI-PCI bridges referred to as the MCH Host-AGP bridge. On
the Primary bus side, the “virtual” PCI-PCI bridge is attached to PCI Bus #0. Therefore, the
Primary Bus Number register is hardwired to 0. The “virtual” PCI-PCI bridge entity converts Type
#1 PCI Bus Configuration cycles on PCI Bus #0 into Type 0 or Type 1 configuration cycles on the
AGP interface. Type 1 configuration cycles on PCI Bus #0 that have a bus number that matches
the Secondary Bus Number of one of the MCH’s “virtual” P2P bridges will be translated into
Type 0 configuration cycles on the AGP interface.
If the Bus Number is non-zero, greater than the value programmed into the Secondary Bus
Number register, and less than or equal to the value programmed into the Subordinate Bus Number
register, the MCH will generate a Type 1 PCI configuration cycle on AGP.
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