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參數(shù)資料
| 型號： | AD1835AASZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 20/24頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CODEC 2ADC/8DAC 24BIT 52-MQFP |
| 標準包裝： | 1 |
| 類型： | 立體聲音頻 |
| 數(shù)據(jù)接口： | 串行 |
| 分辨率（位）： | 24 b |
| ADC / DAC 數(shù)量： | 2 / 8 |
| 三角積分調(diào)變： | 是 |
| S/N 比，標準 ADC / DAC (db)： | 105 / 108 |
| 動態(tài)范圍，標準 ADC / DAC (db)： | 105 / 108 |
| 電壓 - 電源，模擬： | 4.5 V ~ 5.5 V |
| 電壓 - 電源，數(shù)字： | 4.5 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 52-QFP |
| 供應商設備封裝： | 52-MQFP（10x10） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 776 (CN2011-ZH PDF) |
REV. A
AD1835A
–5–
Parameter
Min
Max
Unit
Comments
TDM256 MODE (Master, 48 kHz and 96 kHz)
tTBD
BCLK Delay
40
ns
From MCLK Rising
tFSD
FSTDM Delay
5
ns
From BCLK Rising
tTABDD
ASDATA Delay
10
ns
From BCLK Rising
tTDDS
DSDATA1 Setup
15
ns
To BCLK Falling
tTDDH
DSDATA1 Hold
15
ns
From BCLK Falling
TDM256 MODE (Slave, 48 kHz and 96 kHz)
fAB
BCLK Frequency
256
fS
tTBCH
BCLK High
17
ns
tTBCL
BCLK Low
17
ns
tTFS
FSTDM Setup
10
ns
To BCLK Falling
tTFH
FSTDM Hold
10
ns
From BCLK Falling
tTBDD
ASDATA Delay
15
ns
From BCLK Rising
tTDDS
DSDATA1 Setup
15
ns
To BCLK Falling
tTDDH
DSDATA1 Hold
15
ns
From BCLK Falling
TDM512 MODE (Master, 48 kHz)
tTBD
BCLK Delay
40
ns
From MCLK Rising
tFSD
FSTDM Delay
5
ns
From BCLK Rising
tTABDD
ASDATA Delay
10
ns
From BCLK Rising
tTDDS
DSDATA1 Setup
15
ns
To BCLK Falling
tTDDH
DSDATA1 Hold
15
ns
From BCLK Falling
TDM512 MODE (Slave, 48 kHz )
fAB
BCLK Frequency
512
fS
tTBCH
BCLK High
17
ns
tTBCL
BCLK Low
17
ns
tTFS
FSTDM Setup
10
ns
To BCLK Falling
tTFH
FSTDM Hold
10
ns
From BCLK Falling
tTBDD
ASDATA Delay
15
ns
From BCLK Rising
tTDDS
DSDATA1 Setup
15
ns
To BCLK Falling
tTDDH
DSDATA1 Hold
15
ns
From BCLK Falling
AUXILIARY INTERFACE (48 kHz and 96 kHz)
tAXDS
AAUXDATA Setup
10
ns
To AUXBCLK Rising
tAXDH
AAUXDATA Hold
10
ns
From AUXBCLK Rising
fABP
AUXBCLK Frequency
64
fS
Slave Mode
tAXBH
AUXBCLK High
15
ns
tAXBL
AUXBCLK Low
15
ns
tAXLS
AUXLRCLK Setup
10
ns
To AUXBCLK Rising
tAXLH
AUXLRCLK Hold
10
ns
From AUXBCLK Rising
Master Mode
tAUXLRCLK
AUXLRCLK Delay
15
ns
From AUXBCLK Falling
tAUXBCLK
AUXBCLK Delay
20
ns
From MCLK Rising
Specifications subject to change without notice.
MCLK
t
MH
PD/RST
t
ML
t
PDR
t
MCLK
Figure 1. MCLK and
PD/ RST Timing
相關(guān)PDF資料 |
PDF描述 |
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| AD1835AS | 制造商:Analog Devices 功能描述:Audio Codec 2ADC / 8DAC 24-Bit 52-Pin MQFP 制造商:Analog Devices 功能描述:AUD CODEC 2ADC / 8DAC 24BIT 52MQFP - Trays 制造商:Rochester Electronics LLC 功能描述:HIGH PERFORMANCE 2:8 CODEC - Bulk |
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| AD1836A | 制造商:AD 制造商全稱:Analog Devices 功能描述:Multichannel 96 kHz Codec |
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