Loop voltage = 24 V; REFIN = REFOUT1 (2.5 V internal reference); RL <" />
參數(shù)資料
型號： AD5421BREZ
廠商： Analog Devices Inc
文件頁數(shù)： 35/36頁
文件大?。?/td> 0K
描述： IC DAC 16BIT 1.8-12V 28TSSOP
標準包裝： 50
設(shè)置時間： 50µs
位數(shù)： 16
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 1
電壓電源： 單電源
功率耗散（最大）： 625mW
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 28-SOIC（0.173"，4.40mm 寬）裸露焊盤
供應(yīng)商設(shè)備封裝： 28-TSSOP 裸露焊盤
包裝： 管件
輸出數(shù)目和類型： 1 電壓，單極
采樣率（每秒）： *
AD5421
Data Sheet
Rev. G | Page 8 of 36
Loop voltage = 24 V; REFIN = REFOUT1 (2.5 V internal reference); RL = 250 ; external NMOS connected; all loop current ranges;
all specifications TMIN to TMAX, unless otherwise noted.
Table 2.
Parameter1, 2
C Grade
Unit
Test Conditions/Comments
Min
Typ
Max
ACCURACY, INTERNAL RSET
Total Unadjusted Error (TUE)3
0.157
+0.157
% FSR
0.117
±0.0172
+0.117
% FSR
TA = 25°C
Relative Accuracy (INL)
0.004
+0.004
% FSR
0.004
±0.0015
+0.004
% FSR
TA = 25°C
Offset Error
0.04
+0.04
% FSR
0.025
±0.0025
+0.025
% FSR
TA = 25°C
Offset Error TC
1
ppm FSR/°C
Gain Error
0.128
+0.128
% FSR
0.093
±0.0137
+0.093
% FSR
TA = 25°C
Gain Error TC
5
ppm FSR/°C
Full-Scale Error
0.157
+0.157
% FSR
0.117
±0.0172
+0.117
% FSR
TA = 25°C
Full-Scale Error TC
6
ppm FSR/°C
ACCURACY, EXTERNAL RSET (24 k)
Assumes ideal resistor
Total Unadjusted Error (TUE)3
0.133
+0.133
% FSR
0.133
±0.0252
+0.133
% FSR
TA = 25°C
Relative Accuracy (INL)
0.004
+0.004
% FSR
0.004
±0.0015
+0.004
% FSR
TA = 25°C
Offset Error
0.029
+0.029
% FSR
0.029
±0.0038
+0.029
% FSR
TA = 25°C
Offset Error TC
0.5
ppm FSR/°C
Gain Error
0.11
+0.11
% FSR
0.106
±0.0197
+0.106
% FSR
TA = 25°C
Gain Error TC
2
ppm FSR/°C
Full-Scale Error
0.133
+0.133
% FSR
0.133
±0.0252
+0.133
% FSR
TA = 25°C
Full-Scale Error TC
2
ppm FSR/°C
1
Temperature range: 40°C to +105°C; typical at +25°C.
2
Specifications guaranteed by design and characterization; not production tested.
3
Total unadjusted error is the total measured error (offset error + gain error + linearity error + output drift over temperature) after factory calibration of the AD5421.
System level total error can be reduced using the offset and gain registers.
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